在线观看www成人影院-在线观看www日本免费网站-在线观看www视频-在线观看操-欧美18在线-欧美1级

0
  • 聊天消息
  • 系統(tǒng)消息
  • 評論與回復(fù)
登錄后你可以
  • 下載海量資料
  • 學(xué)習(xí)在線課程
  • 觀看技術(shù)視頻
  • 寫文章/發(fā)帖/加入社區(qū)
會員中心
創(chuàng)作中心

完善資料讓更多小伙伴認(rèn)識你,還能領(lǐng)取20積分哦,立即完善>

3天內(nèi)不再提示

CPU Cache偽共享問題

程序喵大人 ? 來源:程序喵大人 ? 作者:程序喵大人 ? 2022-12-12 09:17 ? 次閱讀

先看下這兩段代碼:

代碼段1:

const int row = 10240;
const int col = 10240;
int matrix[row][col];
int TestRow() {
  //按行遍歷
  int sum_row = 0;
  for (int r = 0; r < row; r++) {
    for (int c = 0; c < col; c++) {
      sum_row += matrix[r][c];
    }
  }
  return sum_row;
}

代碼段2:

int TestCol() {
  //按列遍歷
  int sum_col = 0;
  for (int c = 0; c < col; c++) {
    for (int r = 0; r < row; r++) {
      sum_col += matrix[r][c];
    }
  }
  return sum_col;
}

兩段代碼的目的相同,都是為了計算矩陣中所有元素的總和。

但有些區(qū)別:一個是按行遍歷元素做計算,一個是按列遍歷元素做計算。

它倆的運行速度有什么區(qū)別嗎?

如圖:

圖中可以看到,行遍歷的代碼速度比列遍歷的代碼速度快很多。

為什么按行遍歷的代碼比按列遍歷的代碼速度快?這里就是CPU Cache在起作用。

什么是CPU Cache?

可以先看下這個存儲器相關(guān)的金字塔圖:

從下到上,空間雖然越來越小,但是處理速度越來越快,相應(yīng)的,設(shè)備價格也越來越貴。

圖中的寄存器和主存估計大家都知道,那中間的L1 、L2、L3是什么?它們起到了什么作用?

它們就是CPU 的Cache,如下圖:

可以理解為CPU Cache就是CPU與主存之間的橋梁。

當(dāng)CPU想要訪問主存中的元素時,會先查看Cache中是否存在,如果存在(稱為Cache Hit),直接從Cache中獲取,如果不存在(稱為Cache Miss),才會從主存中獲取。Cache的處理速度比主存快得多。

所以,如果每次訪問數(shù)據(jù)時,都能直接從Cache中獲取,整個程序的性能肯定會更高。

那,如何提高CPU Cache的命中率?

但CPU Cache這里還有個小問題,看下這兩段代碼:

代碼段1:

struct Point {
  std::atomic x;
  // char a[128];
  std::atomic y;
};
void Test() {
  Point point;
  std::thread t1(
      [](Point *point) {
        for (int i = 0; i < 100000000; ++i) {
          point->x += 1;
        }
      },
      &point);
  std::thread t2(
      [](Point *point) {
        for (int i = 0; i < 100000000; ++i) {
          point->y += 1;
        }
      },
      &point);
  t1.join();
  t2.join();
}

代碼段2:

struct Point {
  std::atomic x;
  char a[128];
  std::atomic y;
};
void Test() {
  Point point;
  std::thread t1(
      [](Point *point) {
        for (int i = 0; i < 100000000; ++i) {
          point->x += 1;
        }
      },
      &point);
  std::thread t2(
      [](Point *point) {
        for (int i = 0; i < 100000000; ++i) {
          point->y += 1;
        }
      },
      &point);
  t1.join();
  t2.join();
}

兩端代碼的核心邏輯都是對Point結(jié)構(gòu)體中的x和y不停+1。只有一點區(qū)別就是在中間塞了128字節(jié)的數(shù)組。

它們的執(zhí)行速度卻相差很大。

帶128的比不帶128的代碼,執(zhí)行速度快很多。

為什么?

看過我上面文章的同學(xué)應(yīng)該就知道,每個CPU都有自己的L1和L2 Cache,而Cache line的大小一般是64字節(jié),如果x和y之間沒有128字節(jié)的填充,它倆就會在同一個Cache line上。

代碼中開了兩個線程,兩個線程大概率會運行在不同的CPU上,每個CPU有自己的Cache。

當(dāng)CPU1操作x時,會把y裝載到Cache中,其他CPU對應(yīng)的的Cache line失效。

然后CPU2加載y,會觸發(fā)Cache Miss,它后面又把x裝載到了自己的Cache中,其他CPU對應(yīng)的Cache line失效。

然后CPU1操作x時,又觸發(fā)Cache Miss。

它倆就會是大體這個流程:

頻繁的觸發(fā)Cache Miss,導(dǎo)致程序的性能相當(dāng)差。

而如果x和y中間加了128字節(jié)的填充,x和y不在同一個Cache line上,不同CPU之前不會影響,它倆都會頻繁的命中自己的Cache,整個程序性能就會很高,這就是傳說中的False Sharing問題。

所以我們寫代碼時,可以基于此做深一層思考,如果我們寫單線程程序,最好保證訪問的數(shù)據(jù)能夠相鄰,在一個Cache line上,可以盡可能的命中Cache。

如果寫多線程程序,最好保證訪問的數(shù)據(jù)有間隔,讓它們不在一個Cache line上,減少False Sharing的頻率。

審核編輯:郭婷

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報投訴
  • 存儲器
    +關(guān)注

    關(guān)注

    38

    文章

    7528

    瀏覽量

    164346
  • cpu
    cpu
    +關(guān)注

    關(guān)注

    68

    文章

    10905

    瀏覽量

    213030

原文標(biāo)題:CPU Cache偽共享問題

文章出處:【微信號:程序喵大人,微信公眾號:程序喵大人】歡迎添加關(guān)注!文章轉(zhuǎn)載請注明出處。

收藏 人收藏

    評論

    相關(guān)推薦

    高速緩沖存儲器是內(nèi)存還是外存,高速緩沖存儲器是為了解決什么

    高速緩沖存儲器(Cache)是內(nèi)存的一種特殊形式,但它與通常所說的主存儲器(RAM)有所不同。在計算機存儲體系中,Cache位于CPU和主存儲器之間,用于存儲CPU近期訪問過的數(shù)據(jù)或指
    的頭像 發(fā)表于 01-29 11:48 ?129次閱讀

    請問AD7616是單端輸入還是差分輸入?

    請問 AD7616是單端輸入還是差分輸入
    發(fā)表于 12-19 07:38

    什么是緩存(Cache)及其作用

    緩存(Cache)是一種高速存儲器,用于臨時存儲數(shù)據(jù),以便快速訪問。在計算機系統(tǒng)中,緩存的作用是減少處理器訪問主存儲器(如隨機存取存儲器RAM)所需的時間。 緩存(Cache)概述 緩存是一種位于
    的頭像 發(fā)表于 12-18 09:28 ?1536次閱讀

    請問什么叫差分結(jié)構(gòu)?什么叫真差分信號?

    請問什么叫差分結(jié)構(gòu)?什么叫真差分信號?
    發(fā)表于 12-16 07:33

    OPA1642做一個差分和差分輸出轉(zhuǎn)換的電路,在差分的情況下遇到的問題求解

    我在做一個差分和差分輸出轉(zhuǎn)換的電路,但是在差分的情況下遇到下面的問題,用理想運放仿真負(fù)端就不會出現(xiàn)類似方波的情況,但是用OPA1642就有這個問題,方波的峰峰值大概5V,請幫忙看看是否是前端電阻匹配的不合適,兩個輸入信號是相位相差180度,峰值為5V的正弦波,謝謝
    發(fā)表于 11-07 06:07

    Cache和內(nèi)存有什么區(qū)別

    Cache(高速緩存)和內(nèi)存(Memory,通常指主存儲器或RAM)是計算機存儲系統(tǒng)中兩個重要的組成部分,它們在計算機的性能和數(shù)據(jù)處理中扮演著不同的角色。以下是對Cache和內(nèi)存之間區(qū)別的詳細(xì)解析。
    的頭像 發(fā)表于 09-26 15:28 ?2148次閱讀

    做一個差分和差分輸出轉(zhuǎn)換的電路遇到的疑問求解

    我在做一個差分和差分輸出轉(zhuǎn)換的電路,但是在差分的情況下遇到下面的問題,用理想運放仿真負(fù)端就不會出現(xiàn)類似方波的情況,但是用OPA1642就有這個問題,方波的峰峰值大概5V,請幫忙看看是否是前端電阻匹配的不合適,兩個輸入信號是相位相差180度,峰值為5V的正弦波,謝謝
    發(fā)表于 09-20 06:28

    德國進口蔡司工業(yè)CT去散射影技術(shù)

    CT影始終是制約分析、數(shù)據(jù)處理、可靠性以及準(zhǔn)確度的重大難題。毋庸置疑,影的種類繁多,像是射線硬化、多材料、散射或者環(huán)狀等均在其列。今日,要與諸位分享的乃是鋁壓鑄行業(yè)里最為常見的散射影。即便是
    的頭像 發(fā)表于 09-04 11:20 ?406次閱讀
    德國進口蔡司工業(yè)CT去散射<b class='flag-5'>偽</b>影技術(shù)

    解析Arm Neoverse N2 PMU事件L2D_CACHE_WR

    有客戶希望我們幫忙分析 Eigen gemm 基準(zhǔn)測試的一些執(zhí)行情況。具體來說是為什么 L1D_CACHE_WR 的值會低于 L2D_CACHE_WR,這種情況令人費解。
    的頭像 發(fā)表于 09-03 11:42 ?1381次閱讀
    解析Arm Neoverse N2 PMU事件L2D_<b class='flag-5'>CACHE</b>_WR

    什么是CPU緩存?它有哪些作用?

    CPU緩存(Cache Memory)是計算機系統(tǒng)中一個至關(guān)重要的組成部分,它位于CPU與內(nèi)存之間,作為兩者之間的臨時存儲器。CPU緩存的主要作用是減少
    的頭像 發(fā)表于 08-22 14:54 ?3749次閱讀

    Cortex R52內(nèi)核Cache的具體操作(2)

    本節(jié)內(nèi)容主要講述CortexR52內(nèi)核Cache的具體操作包括使緩存無效(invalidate)操作,清除(clean)緩存。有的時候客戶可能需要對cache做一些清理,比如invalidate
    的頭像 發(fā)表于 07-15 15:44 ?1551次閱讀
    Cortex R52內(nèi)核<b class='flag-5'>Cache</b>的具體操作(2)

    Cortex R52內(nèi)核Cache的相關(guān)概念(1)

    在開始閱讀本系列文章之前,請先參閱《有關(guān)CR52 MPU配置說明》。因為這篇文章講述了,cache配置所涉及到的寄存器的設(shè)置和MPU的一些基本概念。如果讀者都已經(jīng)理解了上述內(nèi)容,可以跳過。本章內(nèi)容主要講述cache屬性的具體含意、注意事項、以及在RZ/T2M的性能測試。
    的頭像 發(fā)表于 07-15 10:37 ?1766次閱讀
    Cortex R52內(nèi)核<b class='flag-5'>Cache</b>的相關(guān)概念(1)

    CortexR52內(nèi)核Cache的具體操作

    本節(jié)內(nèi)容主要講述CortexR52內(nèi)核Cache的具體操作包括使緩存無效(invalidate)操作,清除(clean)緩存。有的時候客戶可能需要對cache做一些清理,比如invalidate
    的頭像 發(fā)表于 07-15 10:32 ?1405次閱讀
    CortexR52內(nèi)核<b class='flag-5'>Cache</b>的具體操作

    為什么HAL庫在操作Flash erase的時候,需要把I-Cache和D-Cache關(guān)閉呢?

    請問為什么HAL庫在操作Flash erase的時候,需要把I-Cache和D-Cache關(guān)閉呢? 這有什么原因呢? 有人可以解答嗎?
    發(fā)表于 04-07 09:08

    請問STM32MP13X的MMU和Cache如何使能?

    STM32MP13X的MMU和Cache如何使能?修改了hal_conf里的DATA_CACHE_ENABLE的宏console里還是顯示沒開,在設(shè)置里的Define symbols把NO_CACHE_USE刪了好像還是不行。。
    發(fā)表于 03-12 06:46
    主站蜘蛛池模板: 色骚网| 劳拉淫欲护士bd字幕 | 天天搞夜夜操 | 狠狠干狠狠插 | 999久久精品国产 | xxxx日本69护士 | 亚洲国产婷婷香蕉久久久久久 | 色久优优 | 一级做a爰片久久毛片鸭王 一级做a爰片久久毛片一 | 日本丝瓜着色视频 | 天天操天天干天天拍 | 99色视频在线观看 | 都市禁忌猎艳风流美妇 | 人人爽人人爱 | aa三级动态图无遮无挡 | 日本特黄绿像大片免费看 | 4438x色| 四大名著成人高h肉版 | 伊人网在线观看 | 亚洲已满18点击进入在线观看 | 国产午夜精品久久久久免费视 | 午夜看毛片 | 在厨房乱子伦在线观看 | 青草青视频在线观看 | 亚洲欧美在线一区二区 | 国产成人精品午夜二三区 | 日韩在线视频一区 | 久久国产乱子伦精品免费午夜 | 四虎国产 | 久久久久久久久久免免费精品 | 精品国产你懂的在线观看 | 日本黄色a级 | 欧美不卡视频在线观看 | 天天色天天舔 | 伊人精品网 | 欧美日韩亚洲色图 | 欧美在线播放 | 欧美一区二区三区四区视频 | 成人av在线电影 | 国产呦在线观看视频 | 男人资源网 |