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使小芯片(Chiplet)成為主流技術(shù)所面臨的最大挑戰(zhàn)是什么?

芯睿半導(dǎo)體 ? 來源:芯睿半導(dǎo)體 ? 作者:芯睿半導(dǎo)體 ? 2022-12-19 15:03 ? 次閱讀

由于測試芯片的復(fù)雜性和覆蓋范圍的原因,單個小芯片對復(fù)合材料成品率下降的影響正在為晶圓測試帶來新的性能要求。從測試的角度來看,使小芯片成為主流技術(shù)取決于確保以合理的測試成本獲得“足夠好的模具”。

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晶圓級測試在小芯片制造過程中扮演著至關(guān)重要的角色。以HBM(高帶寬內(nèi)存)為例,它可以及早發(fā)現(xiàn)有缺陷的DRAM和邏輯芯片,以便可以在復(fù)雜而昂貴的堆疊階段之前將其刪除。堆疊后晶圓的進一步測試可確保完成的堆疊在切割成獨立組件之前具有完整的功能。理想情況下,每個DRAM芯片在堆疊之前都應(yīng)進行已知良好芯片(KGD)測試,以獨立驗證其性能。但這在經(jīng)濟上通常是不可行的。在某些時候,測試成本超過了系統(tǒng)完成后增加的價值。 因此,需要一種平衡測試成本和未做芯片不良率檢測的測試策略,以將異構(gòu)集成引入大批量生產(chǎn)。

得益于MEMS探針卡技術(shù)的創(chuàng)新,F(xiàn)ormFactor的產(chǎn)品可以幫助客戶實現(xiàn)全流程的KGD測試(例如支持45μm柵格陣列間距微凸點測試的Altius探針卡,用于高速HBM和Interposer插入連接器的良品率驗證),并且可以接受有限的測試成本(例如SmartMatrix探針卡,通過同時測試300mm晶圓上的數(shù)千個芯片,大大降低了每個芯片的測試成本)。最終,我們在小型芯片制造過程的每個階段獲得有關(guān)產(chǎn)品性能和成品率的更多信息,從而幫助客戶降低總體制造成本。

審核編輯 :李倩

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報投訴
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原文標(biāo)題:探針臺測試,從晶圓測試角度來看,使小芯片(Chiplet)成為主流技術(shù)所面臨的最大挑戰(zhàn)是什么?

文章出處:【微信號:gh_064d56de9e11,微信公眾號:芯睿半導(dǎo)體】歡迎添加關(guān)注!文章轉(zhuǎn)載請注明出處。

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