現在的高速數字系統的時鐘頻率可能高達數百兆Hz,其快斜率瞬變和極高的工作頻率,以及很大的電路密集度,必將使得系統表現出與低速設計截然不同的行為,出現了信號完整性問題。
破壞了信號完整性將直接導致信號失真、定時錯誤,以及產生不正確數據、地址和控制信號,從而造成系統誤工作甚至導致系統崩潰。
因此,信號完整性問題已經越來越引起高速數字電路設計人員的關注。
如果電路中信號能夠以要求的時序、持續時間和電壓幅度到達IC,則該電路具有較好的信號完整性。
反之,當信號不能正常響應時,就出現了信號完整性問題。
SI(Signal Integrity)解決的是信號傳輸過程中的質量問題,尤其是在高速領域,數字信號的傳輸不能只考慮邏輯上的實現,物理實現中數字器件開關行為的模擬效果往往成為設計成敗的關鍵。
1、過沖
2、毛刺
3、回勾和臺階
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