FPGA優質開源模塊-SRIO IP核的使用
本文介紹一個FPGA常用模塊：SRIO（SerialRapidIO）。SRIO協議是一種高速串行通信協議，在我參與的項目中主要是用于FPGA和DSP之間的高速通信。有關SRIO協議的詳細介紹網上有很多，本文主要簡單介紹一下SRIO IP核的使用和本工程的源代碼結構。
由于Vivado中RapidIO IP核需要付費才能使用，因此本文提供完整工程源碼。文章末尾有該工程源碼獲取方式，有需要的小伙伴可以收藏、分享一下。
01
軟硬件平臺
軟件平臺：Vivado 2017.4;
硬件平臺：XC7K410T...;
02
?IP核參數配置
本工程SRIO IP核參數配置如下圖所示，僅供參考：
03
工程源碼結構
下圖是SRIO工程源碼結構：
其中，
SRIO_Auto_rst_Mod：SRIO自動復位模塊；
srio_request_gen：SRIO請求事務生成模塊；
srio_response_gen：SRIO響應事務生成模塊；
RapidIO_switch_maintr_mod & srio_quick_start：SRIO維護事務生成模塊。
04
實現功能
該FPGA SRIO模塊采用NWRITE類型事務往DSP目的地址傳輸數據，每包數據大小為256字節。數據寫入完畢后，通過DOORBELL事務給DSP發送數據接收中斷。另外FPGA端通過RapidIO IP核m_axis_treq接口接收來自DSP的數據。
審核編輯：劉清
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原文標題：FPGA優質開源模塊 - SRIO
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