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ADL5205數(shù)字控制、寬帶寬、可變?cè)鲆骐p通道放大器(DGA)技術(shù)手冊(cè)

要長(zhǎng)高 ? 2025-03-12 14:24 ? 次閱讀

概述

ADL5205是一款數(shù)字控制、寬帶寬、可變?cè)鲆骐p通道放大器(DGA),可以提供精密增益控制、高輸出三階交調(diào)截點(diǎn)(OIP3)和幾乎恒定的噪聲系數(shù)(針對(duì)12 dB第一衰減)。48.5 dBm的出色OIP3性能(200 MHz、5 V、高性能模式和最大增益時(shí))使之成為各種接收器應(yīng)用的卓越增益控制器件。

對(duì)于寬輸入動(dòng)態(tài)范圍應(yīng)用,ADL5205能以1 dB的步長(zhǎng)提供35 dB寬增益范圍。增益可通過多種增益控制和接口選項(xiàng)進(jìn)行調(diào)整:并行、SPI或增益升降控制。

ADL5205的兩個(gè)通道均通過對(duì)PWUPA和PWUPB引腳施加適當(dāng)?shù)倪壿嬰娖絹愍?dú)立上電。ADL5205針對(duì)高性能模式和低功耗模式的典型靜態(tài)電流分別為175 mA和135 mA。禁用時(shí),其功耗僅為14 mA,可以提供出色的輸入-輸出隔離。當(dāng)器件禁用時(shí),增益設(shè)置保持不變。

ADL5205采用ADI公司的高速、硅鍺(SiGe)互補(bǔ)BiCMOS工藝制造,提供精密增益調(diào)整功能和良好的失真性能。它采用緊湊的散熱增強(qiáng)型6 mm × 6 mm、40引腳LFCSP封裝,工作溫度范圍為?40°C至+85°C。

請(qǐng)注意,在整篇數(shù)據(jù)手冊(cè)中,多功能引腳(如CSA/A3)由整個(gè)引腳名稱或引腳的單個(gè)功能表示;例如CSA即表示僅與此功能相關(guān)。
數(shù)據(jù)表:*附件:ADL5205數(shù)字控制、寬帶寬、可變?cè)鲆骐p通道放大器(DGA)技術(shù)手冊(cè).pdf

特性

  • 獨(dú)立的雙通道數(shù)字控制增益放大器(DGA)
  • 增益范圍:-9 dB至+26 dB
  • 1 dB步長(zhǎng),±0.2 dB精度(200 MHz)
  • 100 ?差分輸入電阻
  • 10 ?差分輸出電阻
  • 1.2 dB噪聲系數(shù)變化(針對(duì)12 dB第一增益衰減)
  • 輸出三階交調(diào)截點(diǎn)(OIP3):48.5 dBm (200 MHz)、5V、高性能模式
  • ?3 dB帶寬:1700 MHz(典型值,高性能模式下)
  • 多種控制接口選項(xiàng)
    • 并行6位控制接口(集成鎖存器)
    • 串行外設(shè)接口(SPI)(集成快速啟動(dòng)功能)
    • 增益升/降接口
  • 寬輸入動(dòng)態(tài)范圍
  • 低功耗模式
  • 掉電控制
  • 3.3 V或5 V單電源供電
  • 40引腳、6 mm × 6 mm LFCSP封裝

應(yīng)用

框圖
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引腳配置和功能描述
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典型性能特征
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ADL5205在輸入/輸出耦合方面非常靈活。它可以交流耦合或直流耦合到輸入和/或輸出,額定輸出共模電平為1.2 V至2.7 V,具體取決于電源電壓。如果沒有施加外部輸出共模電壓,輸入和輸出共模電壓在內(nèi)部設(shè)置為電源電壓的一半。
ADL.5205的輸出共模電壓由VCMA和VCMB引腳上的電壓控制。這些引腳通過5 kQ電阻內(nèi)部連接到VPOS引腳和裸露焊盤(EP)。因此,每個(gè)通道的共模輸出電壓在內(nèi)部預(yù)設(shè)為VPOS電源電壓的一半。或者,VCMA和VCMB引腳可以連接到ADC的共模電壓基準(zhǔn)輸出,這樣,兩個(gè)器件之間的共模電平可以匹配,而無需任何外部元件。
image.png

圖51顯示了操作ADL5205的基本連接。對(duì)VPOS引腳施加3.3 V或5 V的電壓。每個(gè)電源引腳至少應(yīng)去耦一個(gè)0.1 uF的低電感表面貼裝陶瓷電容,電容應(yīng)盡可能靠近器件。差分輸出的直流共模電壓約為電源電壓的一半;因此,使用0.1 uF電容將這些輸出去耦至平衡負(fù)載。平衡差分輸入與輸出具有相同的共模電壓;輸入也使用0.1 uF電容去耦。數(shù)字引腳、模式控制引腳、相關(guān)SPI引腳和并行增益控制引腳(PM、PWUPA和PWUPB)采用3.3 V電壓工作。
要使能ADL5205的每個(gè)通道,請(qǐng)將PWUPA引腳或PWUPB引腳拉高(2.0 V ≤ PWUPA/PWUPB ≤ 3.3 V)。PWUPA引腳或PWUPB引腳上的logiclow將通道設(shè)置為休眠模式,從而將每個(gè)通道的功耗降至約7 mA。VCMA和VCMB引腳是各通道輸出共模電壓的參考輸入,必須用0.1 uF電容去耦。
image.png

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點(diǎn)僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場(chǎng)。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請(qǐng)聯(lián)系本站處理。 舉報(bào)投訴
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