概述
AD9554-1是一款低環(huán)路帶寬時(shí)鐘倍頻器，可針對包括同步光纖網(wǎng)絡(luò)(SONET/SDH)的許多系統(tǒng)提供抖動(dòng)清除和同步功能。 AD9554-1產(chǎn)生的輸出時(shí)鐘可以與多達(dá)四路外部輸入?yún)⒖紩r(shí)鐘同步。 DPLL可以降低與外部參考時(shí)鐘相關(guān)的輸入時(shí)間抖動(dòng)或相位噪聲。 借助數(shù)字控制環(huán)路和保持電路，即使所有參考輸入都失效，AD9554-1也能持續(xù)產(chǎn)生低抖動(dòng)輸出時(shí)鐘。

AD9554-1的工作溫度范圍為?40℃至+85℃工業(yè)溫度范圍。如需該器件的單DPLL版本，請參考AD9557或AD9559。
數(shù)據(jù)表：*附件：AD9554-1四路PLL、四通道輸入、四通道輸出多服務(wù)線路卡自適應(yīng)時(shí)鐘轉(zhuǎn)換器技術(shù).pdf

應(yīng)用

• 網(wǎng)絡(luò)同步，包括同步以太網(wǎng)和SDH至OTN映射/解映射
• 清除基準(zhǔn)時(shí)鐘抖動(dòng)
• 最高達(dá)到OC-192的SONET/SDH時(shí)鐘，包括FEC
• Stratum 3保持、抖動(dòng)清除及相位瞬態(tài)控制
• 無線基站控制器
• 有線基礎(chǔ)設(shè)施
• 數(shù)據(jù)通信
• 專業(yè)視頻設(shè)備
  特性
• 在保持模式下穩(wěn)定性支持GR-1244 Stratum 3
• 支持平穩(wěn)的參考切換，幾乎不會(huì)干擾輸出相位
• 支持Telcordia GR-253抖動(dòng)產(chǎn)生、轉(zhuǎn)換和容差，適用于SONET/SDH至OC-192系統(tǒng)
• 支持ITU-T G.8262同步以太網(wǎng)從時(shí)鐘
• 支持ITU-T G.823、G.824、G.825和G.8261
• 自動(dòng)/手動(dòng)保持和參考切換
• 自適應(yīng)時(shí)鐘可動(dòng)態(tài)調(diào)整反饋分頻器，用于OTN映射/解映射應(yīng)用
• 四通道數(shù)字PLL架構(gòu)，帶四個(gè)基準(zhǔn)輸入電壓（單端或差分）
• 4x4交叉點(diǎn)允許任意基準(zhǔn)輸入驅(qū)動(dòng)任意PLL
• 輸入?yún)⒖碱l率范圍：2 kHz至1000 MHz
• 參考驗(yàn)證和頻率監(jiān)控：2 ppm
• 可編程設(shè)置輸入?yún)⒖嫉那袚Q優(yōu)先級
• 20位可編程輸入?yún)⒖挤诸l器
• 4路差分時(shí)鐘輸出，每個(gè)差分對均可配置為HCSL、LVDS兼容或LVPECL兼容
• 輸出頻率范圍：430 kHz至941 MHz
• 數(shù)字PLL集成可編程18位整數(shù)和24位小數(shù)反饋分頻器
• 可編程環(huán)路帶寬：0.1 Hz至4 kHz
• 56引腳(8 mm x 8 mm) LFCSP封裝

框圖

引腳配置描述

典型性能特征

操作理論

AD9554 - 1 提供的時(shí)鐘輸出與所選（活動(dòng)）參考信號的相位和頻率直接相關(guān)，但其抖動(dòng)特性由系統(tǒng)時(shí)鐘、數(shù)字控制振蕩器（DCO）和模擬輸出鎖相環(huán)（APLL）決定。AD9554 - 1 可被視為 AD9557 的四個(gè)副本封裝在一起，具有 4:4 交叉點(diǎn)控制的參考輸入。AD9554 - 1 支持多達(dá) 4 個(gè)參考輸入，輸入頻率范圍從 2 Hz 到 1000 MHz。該器件的核心是四個(gè)數(shù)字鎖相環(huán)（DPLL）。每個(gè) DPLL 都有一個(gè)可編程數(shù)字積分器環(huán)路濾波器，可大幅減少從活動(dòng)參考信號轉(zhuǎn)移到輸出的抖動(dòng)，并且這四個(gè) DPLL 完全相互獨(dú)立運(yùn)行。

AD9554 - 1 具備手動(dòng)和自動(dòng)備用功能。在備用模式下，只要系統(tǒng)時(shí)鐘存在，AD9554 - 1 就會(huì)持續(xù)提供輸出，輸出頻率為輸出頻率在備用條件之前的時(shí)間平均值。該器件還提供手動(dòng)和自動(dòng)參考切換功能，當(dāng)活動(dòng)參考信號降級或完全失效時(shí)可進(jìn)行切換。AD9554 - 1 還具有自適應(yīng)時(shí)鐘功能，允許用戶在 DPLL 鎖定時(shí)動(dòng)態(tài)更改 DPLL 分頻比。

AD9554 - 1 包含一個(gè)系統(tǒng)時(shí)鐘乘法器、四個(gè) DPLL 和四個(gè) APLL。輸入信號首先進(jìn)入 DPLL，DPLL 執(zhí)行抖動(dòng)清除操作，并將大部分頻率傳遞給 APLL。每個(gè) DPLL 都配備一個(gè) 30 位至 31 位的 DCO，可在 283 MHz 至 345 MHz 的范圍內(nèi)生成信號。DCO 的輸出進(jìn)入 APLL，APLL 將信號倍頻至 2.4 GHz 至 5.6 GHz，然后將該信號發(fā)送到時(shí)鐘分配部分，該部分由一個(gè) P 分頻器與 10 位通道分頻器（1 分頻至 1024 分頻）級聯(lián)組成。

XOA 和 XOB 輸入為系統(tǒng)時(shí)鐘提供參考。這些引腳可接受 10 MHz 至 268 MHz 范圍內(nèi)的參考時(shí)鐘，或直接連接在 XOA 和 XOB 輸入兩端的 10 MHz 至 50 MHz 晶體。系統(tǒng)時(shí)鐘為頻率監(jiān)視器、DPLL 和內(nèi)部切換邏輯提供時(shí)鐘。

AD9554 - 1 的每個(gè) APLL 都有一個(gè)差分輸出驅(qū)動(dòng)器。每個(gè)輸出驅(qū)動(dòng)器都有一個(gè)專用的 10 位可編程后置分頻器。每個(gè)差分驅(qū)動(dòng)器的工作頻率高達(dá) 1.25 GHz，采用 HCSL 驅(qū)動(dòng)器，內(nèi)部有 58 Ω 終端電阻，具有三種驅(qū)動(dòng)強(qiáng)度：

• 14 mA 模式用于 HCSL 和交流耦合 LVDS。用作 LVDS 兼容驅(qū)動(dòng)器時(shí)，必須進(jìn)行交流耦合，并在差分對兩端跨接一個(gè) 100 Ω 電阻。
• 28 mA 模式產(chǎn)生電壓擺幅，與 LVPECL 兼容。如果需要 LVPECL 信號電平，設(shè)計(jì)者必須交流耦合 AD9554 - 1 輸出。
• 21 mA 模式介于上述兩種設(shè)置之間。

AD9554 - 1 還包括一個(gè)去阻尼控制功能，允許用戶通過周期性寫入實(shí)際電平以及所需的初始電平（先出（FIFO））來動(dòng)態(tài)調(diào)整 AD9554 - 1 的每個(gè)輸出頻率，以匹配用戶系統(tǒng)上的實(shí)際電平。