很多總線標(biāo)準(zhǔn)中，從設(shè)備必須譯碼所有的地址，這稱為全地址譯碼。比如在PCI總線中，每一個(gè)從設(shè)備都必須具有32位的地址輸入，并對(duì)這32位的地址進(jìn)行譯碼以確定如何響應(yīng)主設(shè)備的請(qǐng)求。

片上總線規(guī)范比如Wishbone規(guī)范支持部分地址譯碼。在部分地址譯碼總線規(guī)范中，從設(shè)備只需要譯碼自己所使用的地址空間。比如如果一個(gè)從設(shè)備只有4個(gè)地址，它就只需譯碼2比特地址而不是32位地址。這樣做的好處是：地址譯碼速度快，地址譯碼邏輯少，從設(shè)備可自由定義地址總線寬度。

圖26 Wishbone部分地址譯碼的實(shí)現(xiàn)

Wishbone部分地址譯碼的實(shí)現(xiàn)如圖26所示。對(duì)于圖中所示IP核，我們假設(shè)其只有4個(gè)地址，對(duì)應(yīng)4組寄存器。地址譯碼器首先譯碼出其地址并給出選擇信號(hào)，該選擇信號(hào)與共享總線的STB_O相與輸入到IP核的STB_I。而地址總線的最低2位被直接連接到IP核，IP核再根據(jù)這兩位譯碼出當(dāng)前操作選中的是具體哪個(gè)寄存器。

Wishbone共享總線示例中的仲裁器可以設(shè)計(jì)如下：

//the ACMP0 is for slave0: Flash

//the ACMP1 is for slave1: SRAM

module address_decoder2S(addr_i,ACMP0,ACMP1);

input [31:0]addr_i;

output ACMP0,ACMP1;

parameter ADDR_LOW_S0=32'b0;

parameter ADDR_HIGH_S0=32'h1FFFFF;//2M space for Slave 0;

//the rest of the space for Slave 1,so we do not need a dummuy slave;

assign ACMP0=addr_i<=ADDR_HIGH_S0;

assign ACMP1=~ACMP0;

endmodule