一文詳細了解可編程邏輯器件(PLD)
在過去的十年中,可編程邏輯器件(PLD)市場不斷增長,對PLD的需求不斷增加。具有可編程特性且可編程....
FPGA設計流程
現(xiàn)代FPGA的體系結構包括CLB陣列、塊RAM、乘法器、DSP、IOB和數(shù)字時鐘管理器(DCM)。延....
Verilog時序邏輯中同步計數(shù)器的功能和應用
沒有任何寄存器邏輯,RTL設計是不完整的。RTL是寄存器傳輸級或邏輯,用于描述依賴于當前輸入和過去輸....
Verilog設計中函數(shù)和任務的作用分析
任務和函數(shù)在Verilog中用于描述常用的功能行為。與其在不同的地方復制相同的代碼,不如根據(jù)需求使用....
Verilog RTL和觸發(fā)器中的同步和異步復位功能分析
沒有任何寄存器邏輯,RTL設計是不完整的。RTL是寄存器傳輸級或邏輯,用于描述依賴于當前輸入和過去輸....
硬件開源編程利器MyHDL簡介
自從1995年Verilog HDL 1364-1995標準發(fā)布至今已經(jīng)20多年了,說他經(jīng)久不衰并不....
異步設計之Verilog時序分析
沒有任何寄存器邏輯,RTL設計是不完整的。RTL是寄存器傳輸級或邏輯,用于描述依賴于當前輸入和過去輸....
GameBoy硬件介紹及FPGA實現(xiàn)
拯救童年系列-GameBoy介紹及FPGA實現(xiàn) 這個掌上游戲機應該不需要過多言語,大部分的80后、9....
Verilog/FPGA開源項目介紹
優(yōu)秀的 Verilog/FPGA開源項目介紹(七)- CAN0、CAN總線介紹《【科普】CAN總線介....
詳解串行總線中的SATA協(xié)議
書接上回-《串行總線技術(一)-串行總線結構(以PCIe為例)》《串行總線技術(二)-串行總線中的先....
異構計算發(fā)展趨勢的助力
1.什么是DPU DPU(Data Processing Unit)是以數(shù)據(jù)為中心構造的專用處理器,....
Vivado中運行時出現(xiàn)visual c++運行錯誤該如何解決
Vivado中運行時出現(xiàn)visual c++運行錯誤的解決辦法Win10系統(tǒng)中運行Vivado一直好....

串行總線的優(yōu)缺點優(yōu)點
串行總線技術(一)-串行總線結構(以PCIe為例)串行總線的出現(xiàn)在早期的計算機系統(tǒng)中,多數(shù)外圍設備使....
Vivado中XDC文件的約束順序
很對人在使用Vivado時喜歡使用多個約束文件對整個工程進行約束,同時Vivado允許設計者使用一個....