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      XL FPGA技術交流

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      的頭像 XL FPGA技術交流 發表于 11-01 11:06 ?575次閱讀

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      在生成SoC時，會生成一個預定義bootloader .bin文件，用于指定soc的工程運行的地址，....
      的頭像 XL FPGA技術交流 發表于 10-31 12:37 ?1160次閱讀
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      易靈思鈦金系列加密方案-V1

      硬件設計要求? 在之前的版本中，加密是通過VCC_AUX來供電的。在新的版本中已經通過單獨的VQPS....
      的頭像 XL FPGA技術交流 發表于 10-30 08:04 ?1598次閱讀
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      易靈思Efinity入門使用-v8

      Step1:點擊設置 Step2:在Top level project path中輸入路徑 ....
      的頭像 XL FPGA技術交流 發表于 10-23 10:37 ?2157次閱讀
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      FPGA軟件Efinity入門使用-v7

      ? 一、 軟件預設置 二、新建工程 三、添加源文件 四、添加管腳約束 五、添加GPIO 六、 PLL....
      的頭像 XL FPGA技術交流 發表于 10-21 18:55 ?1777次閱讀
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      Efinity FIFO IP仿真問題 -v1

      Efinity目前不支持聯合仿真，只能通過調用源文件仿真。 我們生成一個fifo IP命名為fifo....
      的頭像 XL FPGA技術交流 發表于 10-21 11:41 ?1560次閱讀
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      易靈思下載器驅動安裝-v2

      該下載器把SPI與JTAG管腳進行了分開處理。鑒于JTAG使用較多，SPI使用較少，所以把JTAG放....
      的頭像 XL FPGA技術交流 發表于 10-16 18:29 ?2086次閱讀
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      邏輯布線鎖定 用FPGA實現TDC時的邏輯鎖定和布線鎖定

      在激光雷達中，使用FPGA實現TDC時需要手動約束進位鏈的位置。這里簡單記錄下。 Efinit....
      的頭像 XL FPGA技術交流 發表于 10-15 11:31 ?3356次閱讀
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      RISCV 操作常見問題集 - v5

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      的頭像 XL FPGA技術交流 發表于 09-09 18:14 ?1210次閱讀
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      SCL：上升沿將數據輸入到每個EEPROM器件中；下降沿驅動EEPROM器件輸出數據。(邊沿觸發) ....
      的頭像 XL FPGA技術交流 發表于 08-13 18:19 ?1082次閱讀

      programmer下載常見問題總結-v2

      programmer下載常見問題總結
      的頭像 XL FPGA技術交流 發表于 08-13 16:17 ?2133次閱讀
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      Efinity編譯生成文件使用指導-v1

      接上篇： （6）查看Unassigned Core Pins。 在placement下面的palce....
      的頭像 XL FPGA技術交流 發表于 08-13 14:22 ?1073次閱讀
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      （1）查看綜合后的原語 在outflow .map是網表對FPGA資源的映射。比如gbuf,dspt....
      的頭像 XL FPGA技術交流 發表于 08-13 11:51 ?1768次閱讀
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      LVDS的GCLK接收方案-v1

      在易靈思的器件上接收LVDS一般采用PLL接收，通過PLL產生兩個時鐘，一個是fast_clk，一個....
      的頭像 XL FPGA技術交流 發表于 08-13 08:44 ?869次閱讀
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      的頭像 XL FPGA技術交流 發表于 08-12 17:11 ?2024次閱讀
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      programmer下載常見問題總結-v4

      連接下載器之后什么也讀不出來？一般為驅動沒有安裝，在device manger里面查看是否有libu....
      的頭像 XL FPGA技術交流 發表于 08-06 15:21 ?3031次閱讀
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      programmer下載常見問題總結-v3

      （0）連接下載器之后什么也讀不出來 說明 ：一般為驅動沒有安裝，在device manger里面查看....
      的頭像 XL FPGA技術交流 發表于 07-30 08:43 ?1386次閱讀
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      FL60D2GF225及demo板介紹

      FL60F225D2G器件簡介 FL60F225D2G 采用 System in Package（S....
      的頭像 XL FPGA技術交流 發表于 07-29 08:39 ?1413次閱讀
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      易靈思Trion FPGA PS配置模式--update(6)

      準備工作 PS模式首先要把Bitstream Generation中的 （1）JTAG模式選擇為Pa....
      的頭像 XL FPGA技術交流 發表于 07-23 08:48 ?1038次閱讀
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      易靈思SOC onchip RAM初始化

      最新有客戶在詢問soc的片上RAM啟動方案。于是有了本篇文章。如果soc不? ? ? ? 使用外部存....
      的頭像 XL FPGA技術交流 發表于 07-21 16:54 ?1248次閱讀
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      InterfaceDesinger 使用案例-v3

      ? 1、?DDIO用法 2、 時鐘輸出 3、 Efinity處理三態端口問題 4、 PLL的添加? ....
      的頭像 XL FPGA技術交流 發表于 07-17 16:24 ?1907次閱讀
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      Efinity debuger常見問題總結-v2

      Efinity在Debug時會出現UUID mismatch錯誤。很多剛開始使用的人經常遇到。下面我....
      的頭像 XL FPGA技術交流 發表于 07-11 11:39 ?2691次閱讀
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      自從新版本的Efinity RISC-V IDE發布之后，這直沒有時間操作一下，它為RISC-V '....
      的頭像 XL FPGA技術交流 發表于 07-09 08:46 ?1913次閱讀
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      二進制處理中的一些技巧

      在二進制和十進制的處理中，有時候一些小技巧是很有用的。 1、把十進制數轉換成二進制數 （....
      的頭像 XL FPGA技術交流 發表于 07-05 11:51 ?974次閱讀

      verilog系統函數

      （1）fwrite是需要觸發條件的，需要手動添加換行。 （2）如果寫放文件的格式為%d，則認為....
      的頭像 XL FPGA技術交流 發表于 07-05 11:48 ?1352次閱讀
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      1.5G MIPI dsi TX移植注意事項及demo - update8

      硬件平臺 軟件平臺： 使用注意事項 MIPI Dsi的使用相比于CSI多了一些寄存器控制，生成的ex....
      的頭像 XL FPGA技術交流 發表于 06-27 08:43 ?1674次閱讀
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