無(wú)任是用CPU作為系統(tǒng)的主要器件,還是用FPGA作為系統(tǒng)的主要器件,系統(tǒng)設(shè)計(jì)中首先要考慮到的問(wèn)題就是處理器的啟動(dòng)加載問(wèn)題。XILINX推出的ZYNQ可擴(kuò)展處理平臺(tái),片內(nèi)包括兩個(gè)高性能的ARM Cortex A9硬核(稱(chēng)為處理系統(tǒng)processing system (PS))和FPGA(稱(chēng)為可編程邏輯programmable logic (PL)),在基于該平臺(tái)的系統(tǒng)設(shè)計(jì)時(shí)具有極大的靈活性,本文就ZYNQ系統(tǒng)設(shè)計(jì)時(shí)都會(huì)遇到啟動(dòng)加載問(wèn)題作一個(gè)拋磚引玉的描述,如有不當(dāng)之處還請(qǐng)高手斧正。^_^一、器件配置單元ZYNQ器件都帶有一個(gè)器件配置單元(device configuration unit (DEVCFG) ),該模塊由PS控制,提供軟件控制下的PS和PL的初始化和配置功能。以前單個(gè)FPGA器件提供的下載方法已經(jīng)不在適用,PL的配置下載必須在PS的參與下進(jìn)行。Zynq-7000的器件配置單元包括下面的PS單元:①CPU②OCM(引導(dǎo)ROM和共享RAM)③ 部分頂層總線(xiàn)和外設(shè)④PS器件配置模塊在PL側(cè),下面的單元也將參與:①PLS器件配置邏輯和接口② 解密/鑒權(quán)硬件③存儲(chǔ)在eFUSE單元或者電池備份RAM(BBRAM)內(nèi)的解密密鑰下圖為PS器件配置子系統(tǒng)框圖:[[wysiwyg_imageupload:1338:]]提供的關(guān)鍵特性如下:A.提供3種不同的PS配置方法,包括2種主模式和1種從模式。① 加密主模式② 非加密主模式③ 非加密從模式B.3種不同的主模式啟動(dòng)源①NOR FLASH②NAND FLASH③QSPI FLASHC:JTAG非加密從模式D:用AES-256和HMAC (SHA-256)進(jìn)行PS/PL的加密下載E:高速配置用的主DMA接口F:100 MHz 32-bit PCAP流接口H:SoC加密調(diào)試功能在系統(tǒng)上電復(fù)位時(shí),PS采樣專(zhuān)用bootstrapping signals引腳電平來(lái)決定從什么方式引導(dǎo)器件。這個(gè)引導(dǎo)過(guò)程是由一個(gè)Cortex A9核執(zhí)行片內(nèi)的ROM code實(shí)現(xiàn)的,ROM code的功能是初始化L1 cache和基本的總線(xiàn)系統(tǒng),加載相應(yīng)的NAND, NOR, Quad-SPI, and PCAP驅(qū)動(dòng),從指定接口加載第一級(jí)BOOTLOADER(the first stage boot loader (FSBL))到片內(nèi)執(zhí)行。由于OCM RAM大小有限制,第一級(jí)BOOTLOADER大小最大為256KB。用戶(hù)只需要按要求提供啟動(dòng)映像和設(shè)置正確的bootstrapping signals引腳電平,系統(tǒng)上電復(fù)位時(shí)由ROM code自動(dòng)加載到片內(nèi)并且程序調(diào)轉(zhuǎn)到啟動(dòng)映像,此時(shí)系統(tǒng)的全部控制功能交由用戶(hù)的啟動(dòng)映像控制,用戶(hù)如要實(shí)現(xiàn)的第二級(jí)BOOTLOADER功能由啟動(dòng)映像的程序?qū)崿F(xiàn)。對(duì)于加密配置方法,需要用到AES-256解密代碼和SHA-256簽定(簽名)算法, PS需要用PL內(nèi)硬連線(xiàn)的AES-256 和SHA-256模塊,這時(shí)就要求在加密配置情況下PL就必須上著電,既使系統(tǒng)并不配置PL部分也需上電。器件的加密密鑰可以由用戶(hù)選擇是存儲(chǔ)在片內(nèi)的eFUSE單元(具有掉電非易失性)或者內(nèi)部電池供電的BBRAM內(nèi)(具有掉電易失性,適用于安全級(jí)別要求更高的場(chǎng)合), 下表總結(jié)了配置模式和相關(guān)信息:[[wysiwyg_imageupload:1339:]]二、PS非加密主模式配置過(guò)程這種模式下PS啟動(dòng)映像是直接從外部非易失存儲(chǔ)器(NAND, NOR, Quad-SPI)內(nèi)加載到片內(nèi)OCM內(nèi),隨后PL映像可以直接配置到PL內(nèi),整個(gè)過(guò)程如下圖示:[[wysiwyg_imageupload:1340:]]PL映像的配置可由配置接口模塊用DMA來(lái)高速實(shí)現(xiàn),在非加密情況下速度可以達(dá)到400MB/s, 加密情況下速度可以達(dá)到100MB/s, 這在FPGA需要部分重配置時(shí)十分有用。三、PS加密主模式配置過(guò)程PS加密主模式用到了位與片內(nèi)PL部分的硬件AES-256解密模塊和SHA-256模塊來(lái)對(duì)PS啟動(dòng)映像進(jìn)行解密和完整性鑒定,器件密鑰存儲(chǔ)在片內(nèi)的eFUSE單元或者內(nèi)部BBRAM內(nèi),當(dāng)PS加載成功后,用戶(hù)可以選擇用下面缺省的PL引導(dǎo)過(guò)程來(lái)配置PL部分,如下圖示:[[wysiwyg_imageupload:1341:]]其中配置PL時(shí)的比特流既可以是已經(jīng)經(jīng)過(guò)AES-256加密的比特流,也可以是先經(jīng)過(guò)PS先進(jìn)行解密后成為明文比特流送到PL內(nèi),這個(gè)過(guò)程的保密性由用戶(hù)選擇使用。在保密ROM引導(dǎo)階段如果PS完整性鑒定失敗,CPU就立即斷言PROG_B信號(hào)而清除PL內(nèi)容,同時(shí)發(fā)出一個(gè)加密復(fù)位信號(hào),這使PS內(nèi)部的RAM和寄存器進(jìn)行復(fù)位,然后CPU進(jìn)入睡眠模式,系統(tǒng)只有重復(fù)上電才能復(fù)位。PL配置發(fā)生在BOOT的第二階段,這個(gè)過(guò)程完成可以由用戶(hù)選擇自己的方法在任何時(shí)間內(nèi)來(lái)配置一次或多次,并不需要一定按缺省的PL引導(dǎo)過(guò)程來(lái)配置PL部分。四、啟動(dòng)模式引腳ZYNQ器件有5個(gè)啟動(dòng)模式信號(hào)mode[4:0],用來(lái)指出從哪里啟動(dòng),是否是JTAG模式,PLL是否旁路等。另外有兩個(gè)電壓模式信號(hào)vmode[1:0]用來(lái)指明MIO BANK的電壓模式,vmode[1:0] 信號(hào)和mode[4:0] 信號(hào)通過(guò)上拉和下拉來(lái)確定電平值,上拉和下拉電阻建議為20k歐姆,上拉是連接到VCCO_MIO0電壓,下拉是連接到地。系統(tǒng)在釋放PS_POR_B復(fù)位腳后這些啟動(dòng)模式引腳信號(hào)會(huì)被采樣3個(gè)PS_CLK時(shí)鐘用來(lái)確定啟動(dòng)方式。vmode[1:0] 信號(hào)和mode[4:0] 信號(hào)對(duì)應(yīng)的I/O管腳為MIO[8:2],各信號(hào)具體含義如下:①M(fèi)ode[0] 用來(lái)指明是否是JTAG 模正。②Mode[3:1]用來(lái)選擇啟動(dòng)源,是從NOR Flash還是從NAND Flash還是從QSPI啟動(dòng)。③Mode[4]用來(lái)使能PLL。④Vmode[1:0] 用來(lái)配置I/O BANK電壓。這些信號(hào)和MIO管腳的對(duì)應(yīng)關(guān)系如下表表示:[[wysiwyg_imageupload:1342:]]注:上表中X表示不關(guān)心。實(shí)際設(shè)計(jì)中,由于MIO管腳數(shù)量有限(只有54個(gè)),且只分為兩個(gè)BANK(MIO Bank 0對(duì)應(yīng)管腳為PS_MIO[15:0],PS_CLK,PS_POR_B;MIO Bank 1對(duì)應(yīng)管腳為PS_MIO[53:16],PS_VREF_MIO和PS_SRST_B),并不建議系統(tǒng)設(shè)計(jì)為從并行的NOR Flash啟動(dòng),因?yàn)檫@種方式NOR Flash占用的MIO管腳數(shù)量大多(大于40個(gè)管腳),系統(tǒng)設(shè)計(jì)為從NAND Flash或QSPI啟動(dòng)都可以,這兩種方式占用的MIO管腳數(shù)量要少些,NAND Flash的優(yōu)點(diǎn)是容量比較大,缺點(diǎn)是讀寫(xiě)速度要慢些(典型速度10MB/s), QSPI也是一種NOR Flash,不過(guò)接口是四線(xiàn)串行接口,可以獲得比較高的讀寫(xiě)速度(典型速度50MB/s),如果系統(tǒng)希望從其它方式如USB, Ethernet, SD/SDIO等方式啟動(dòng),這都需要用戶(hù)在第一級(jí)啟動(dòng)映像內(nèi)自行設(shè)計(jì)啟動(dòng)引導(dǎo)代碼。以上拋磚引玉,歡迎大家補(bǔ)充說(shuō)明,主要參考文獻(xiàn)為Zynq-7000 Extensible Processing Platform Technical Reference Manual,大家可到XILINX官方網(wǎng)站上下載來(lái)仔細(xì)研究。
ZYNQ器件的啟動(dòng)配置方法
- FPGA(591969)
- 賽靈思(130433)
- Xilinx(119164)
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如何使用Windows在Zynq 7000主板上啟動(dòng)linux?
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2019-04-09 13:12:21
玩轉(zhuǎn)Zynq連載1——Zynq的linux啟動(dòng)過(guò)程
`玩轉(zhuǎn)Zynq連載1——Zynq的linux啟動(dòng)過(guò)程更多資料共享 鏈接:https://share.weiyun.com/5s6bA0s1概述 簡(jiǎn)單的,以u(píng)g585中的一張圖來(lái)看,從大的方面說(shuō)
2019-04-16 06:56:32
玩轉(zhuǎn)Zynq連載22——[ex03] 基于Zynq PL的PLL配置實(shí)例
`玩轉(zhuǎn)Zynq連載22——[ex03] 基于Zynq PL的PLL配置實(shí)例更多資料共享騰訊微云鏈接:https://share.weiyun.com/5s6bA0s百度網(wǎng)盤(pán)鏈接:https
2019-09-06 08:13:18
玩轉(zhuǎn)Zynq連載28——[ex50] 第一個(gè)Zynq系統(tǒng)工程“Hello Zynq”
Zynq,而是如何新建Zynq系統(tǒng)模塊、配置PS的參數(shù)、導(dǎo)出硬件、新建軟件工程并且在線(xiàn)板級(jí)運(yùn)行起來(lái)。流程很重要,大家在開(kāi)始的時(shí)候總要先走一遍流程了解開(kāi)發(fā)的全貌,然后再細(xì)細(xì)把玩,逐個(gè)精通。 2 新建
2019-09-30 12:57:32
玩轉(zhuǎn)Zynq連載29——[ex51] 制作裸跑程序的啟動(dòng)文件BOOT.bin
Zynq的啟動(dòng)原理,建議參考文檔《玩轉(zhuǎn)Zynq-基礎(chǔ)篇:Zynq的啟動(dòng)過(guò)程.pdf》。 2 導(dǎo)出硬件信息并啟動(dòng)SDK參考文檔《玩轉(zhuǎn)Zynq-工具篇:導(dǎo)出PS硬件配置和新建SDK工程》。 3 創(chuàng)建FSBL工程
2019-09-30 14:11:59
請(qǐng)問(wèn)如何配置rtc中斷線(xiàn)到zynq?
喜如何用zqq的irq no 52到MIO26(gpio中斷)引腳配置中斷線(xiàn)?我正在使用以下devicetree配置i2c1:i2c @ e0005000 {compatible =“cdns
2020-04-24 09:43:51
請(qǐng)問(wèn)如何在zynq和virtex-7之間配置x8,x16,x32的數(shù)據(jù)行?
我正在使用zynq芯片和VIRTEX-7設(shè)計(jì)電路板。我想知道在Zynq PL引腳和Virtex-7 IO引腳之間選擇配置數(shù)據(jù)線(xiàn)(例如Slave SelectMAP X8,X16,X32)的方法。在
2020-06-05 10:31:19
FPGA器件的在線(xiàn)配置方法
摘要:介紹基于SRAM LUT結(jié)構(gòu)的FPGA器件的上電配置方式;著重介紹采用計(jì)算機(jī)串口下載配置數(shù)據(jù)的方法和AT89C2051單片機(jī)、串行EEPROM組成的串行配置系統(tǒng)的設(shè)計(jì)方法及實(shí)現(xiàn)
2006-03-13 19:36:49448
Lattice CPLD器件的在系統(tǒng)動(dòng)態(tài)配置
以下是引用片段: 摘要: 介紹一種利用微控制器動(dòng)態(tài)配置CPLD器件的方法。將配置文件存放在存儲(chǔ)器中,配置文件中的控制代碼驅(qū)動(dòng)在微處理器中運(yùn)行的配置引擎;將配置文件中的配置信息通過(guò)JTAG口移入
2009-06-20 10:44:213034
ACEX 1K系列CPLD配置方法探討
摘 要 :介紹ACEX 1K系列器件的配置方法,對(duì)幾種方法進(jìn)行了分析對(duì)比,并著重論述了應(yīng)用配置器件配置 ACEX 1K系列器件的優(yōu)點(diǎn)。
關(guān)鍵詞 :CPL
2009-06-20 10:51:54478
FPGA器件的在線(xiàn)配置方法
摘要: 介紹基于SRAM LUT結(jié)構(gòu)的FPGA器件的上電配置方式;著重介紹采用計(jì)算機(jī)串口下載配置數(shù)據(jù)的方法和AT89C2051單片機(jī)、串行EEPROM組成的串行配置系統(tǒng)的設(shè)計(jì)方法及
2009-06-20 10:57:261062
RealviewMDK中啟動(dòng)代碼的配置詳解
Realview MDK不僅提供了默認(rèn)的啟動(dòng)代碼,而且這些啟動(dòng)代碼可以通過(guò)圖形化界面配置。啟動(dòng)代碼的圖形化配置界面非常類(lèi)似于Web網(wǎng)頁(yè)的界面,甚至后臺(tái)處理的腳本也與Html語(yǔ)言十分接近。下面將詳細(xì)的解析圖形化界面的設(shè)計(jì)與配置。 啟動(dòng)代碼的配置界面是由程序中的
2011-02-24 16:06:5386
ZYNQ學(xué)習(xí) —— 啟動(dòng)流程分析及各環(huán)節(jié)文件生成流程(ZedBo
網(wǎng)絡(luò)資料收集,關(guān)于啟動(dòng)流程的一些注意點(diǎn),關(guān)于開(kāi)發(fā)板ZYNQ系列的包括MIZ702
2016-05-11 17:30:153
Zynq大家族新增單ARM 核的Zynq 器件,為你提供一個(gè)、二個(gè)、四個(gè)或者六個(gè) ARM 微處理器核的多種選擇
今天,賽靈思 Zynq-7000 SoC 和 Zynq UltraScale+ MPSoC 迎來(lái)一個(gè)新的產(chǎn)品系列及三款最新器件! 新的產(chǎn)品系列被稱(chēng)為Zynq Z-7000S系列,三款新器件分別為
2017-02-08 04:25:13517
閑話(huà)Zynq UltraScale+ MPSoC(連載4)
作者:Hello,Panda Part 2 : Zynq UltraScale+ MPSoC啟動(dòng) 熊貓君在這里討論啟動(dòng)(Boot),主要是想聊它的啟動(dòng)設(shè)備和啟動(dòng)方式。看看啟動(dòng)設(shè)備是否廣泛支持,啟動(dòng)
2017-02-08 08:31:11358
閑話(huà)Zynq UltraScale+ MPSoC(連載4)
作者:Hello,Panda Part 2 : Zynq UltraScale+ MPSoC啟動(dòng) 熊貓君在這里討論啟動(dòng)(Boot),主要是想聊它的啟動(dòng)設(shè)備和啟動(dòng)方式。看看啟動(dòng)設(shè)備是否廣泛支持,啟動(dòng)
2017-02-08 08:31:11339
關(guān)于生成從Flash和SD卡啟動(dòng)的鏡像文件的方法
在《ZYNQ-7000使用總結(jié)(3)——PS和PL部分配合使用》中,我們已經(jīng)可以將PL與PS部分一起使用,并且通過(guò)JTAG下載到板子運(yùn)行。對(duì)于ZYNQ,有多種啟動(dòng)方式,比如從JTAG啟動(dòng)、從QSPI
2019-10-06 16:48:002095
一文詳解ZYNQ器件的啟動(dòng)配置方法
在電子系統(tǒng)設(shè)計(jì)中,無(wú)任是用CPU作為系統(tǒng)的主要器件,還是用FPGA作為系統(tǒng)的主要器件,系統(tǒng)設(shè)計(jì)中首先要考慮到的問(wèn)題就是處理器的啟動(dòng)加載問(wèn)題。
2018-07-12 08:27:009919
ZYNQ 7系列FSBL的啟動(dòng)過(guò)程與配置方法
ZYNQ 7系列所有可編程器件均可以在安全模式下通過(guò)靜態(tài)存儲(chǔ)器配置或者在非安全模式下通過(guò)JTAG或者靜態(tài)存儲(chǔ)器配置。 (1)JTAG模式主要用于開(kāi)發(fā)和調(diào)試 (2)NAND、并行NOR、串行NOR
2017-11-17 10:25:5222027
Xilinx Zynq-7000系列安全配置策略
ZYNQ7000與傳統(tǒng)FPGA有著巨大的差異,它將自己定位為一款A(yù)ll Programmable Soc(軟硬件可編程片上系統(tǒng)),視其為以FPGA作為外設(shè)的雙核ARM A9處理器更加準(zhǔn)切。它的啟動(dòng)
2017-11-17 16:04:377989
構(gòu)建可啟動(dòng)的系統(tǒng)鏡像的過(guò)程
Zynq系列器件。如果是Mircroblaze器件請(qǐng)忽略。產(chǎn)生的“.BIN”啟動(dòng)文件可以利用(PROM programmer)拷貝到Flash或直接拷貝到SD第一個(gè)FAT分區(qū)。
2017-11-21 11:41:15968
Zynq器件三種主要類(lèi)型的存儲(chǔ)控制接口解析
基于Zynq器件的嵌入式開(kāi)發(fā)時(shí),我們不可避免地需要規(guī)劃設(shè)計(jì)使用什么樣類(lèi)型和多大地內(nèi)存與FLASH,本文就ZYNQ器件的存儲(chǔ)控制器作一個(gè)拋磚引玉的描述,以期大家對(duì)它有個(gè)基本了解,如有不當(dāng)或需要補(bǔ)充之處
2017-11-22 08:23:546195
在Zynq SoC上實(shí)現(xiàn)裸機(jī)(無(wú)操作系統(tǒng))軟件應(yīng)用方案
Zynq?-7000 All Programmable SoC在單個(gè)器件上實(shí)現(xiàn)了ARM處理功能與FPGA邏輯獨(dú)特的組合,因此需要雙重的配置過(guò)程,同時(shí)需要考慮處理器系統(tǒng)和可編程邏輯。工程師會(huì)發(fā)
2018-01-12 11:17:155494
Xilinx基于ARM的Zynq-7000和Zynq UltraScale+ MPSoC及RFSoC器件是否存在安全漏洞
本文試圖搞清楚在 Xilinx 基于 ARM 的 Zynq-7000、Zynq UltraScale+ MPSoC 和 Zynq UltraScale+ RFSoC 器件中是否存在任何漏洞。
2018-06-28 15:53:002492
ZYNQ-7000如何生成從Flash和SD卡啟動(dòng)的鏡像文件
ZYNQ-7000如何生成從Flash和SD卡啟動(dòng)的鏡像文件 將PL與PS部分一起使用,并且通過(guò)JTAG下載到板子運(yùn)行。對(duì)于ZYNQ,有多種啟動(dòng)方式,比如從JTAG啟動(dòng)、從QSPI(即Flash
2018-05-28 11:42:145883
藍(lán)牙m(xù)esh安全的啟動(dòng)配置流程分析
1、發(fā)送Beacon信號(hào):如果未經(jīng)啟動(dòng)配置的設(shè)備支持PB-ADV承載層,則其作為未經(jīng)啟動(dòng)配置設(shè)備Beacon進(jìn)行廣播;如果使用的是PB-GATT承載層,則發(fā)送可連接的廣播數(shù)據(jù)包。這就向啟動(dòng)配置設(shè)備(Provisioner)表明未經(jīng)啟動(dòng)配置的設(shè)備已做好準(zhǔn)備,可進(jìn)入啟動(dòng)配置流程。
2018-09-28 08:22:005578
如何使用Xilinx SDK啟動(dòng)電路板及利用Zynq DRAM進(jìn)行測(cè)試
在本視頻中,我們將學(xué)習(xí)如何使用Xilinx SDK啟動(dòng)電路板,利用每個(gè)驅(qū)動(dòng)程序提供的應(yīng)用示例并測(cè)試各種外設(shè)。
我們將詳細(xì)介紹Zynq DRAM測(cè)試,并了解如何利用它進(jìn)行測(cè)試。
2018-11-29 06:50:004666
如何配置和練習(xí)U-Boot的USB主機(jī)功能
了解如何配置和練習(xí)U-Boot的USB主機(jī)功能。
這允許在Zynq上使用USB記憶棒進(jìn)行數(shù)據(jù)存儲(chǔ)和檢索,包括二次啟動(dòng)。
2018-11-29 06:38:002554
Zynq-7000 All Programmable SoC器件的I/O標(biāo)準(zhǔn)
了解設(shè)計(jì)人員在使用Zynq-7000 All Programmable SoC器件時(shí)可用的不同I / O,從標(biāo)準(zhǔn)I / O到串行收發(fā)器以及模擬輸入。
2018-11-26 06:36:002547
Xilinx FSBL如何操作啟動(dòng)Zynq器件
了解Xilinx FSBL如何操作以啟動(dòng)Zynq器件。
包括程序執(zhí)行概述,調(diào)試技巧以及有關(guān)特定引導(dǎo)設(shè)備的信息。
還包括FSBL角度的啟動(dòng)安全性簡(jiǎn)要概述。
2018-11-23 06:32:004237
ZYNQ-7000如何生成從Flash和SD卡啟動(dòng)的鏡像文件
ZYNQ-7000如何生成從Flash和SD卡啟動(dòng)的鏡像文件 將PL與PS部分一起使用,并且通過(guò)JTAG下載到板子運(yùn)行。對(duì)于ZYNQ,有多種啟動(dòng)方式
2018-12-01 08:38:187278
ZYNQ的啟動(dòng)原理和配置
在ps的控制下,可以實(shí)現(xiàn)安全或非安全的配置所有ps和pl。通過(guò)zynq提供的JTAG接口,用戶(hù)可以在外部主機(jī)的控制下對(duì)zynq進(jìn)行配置,zynq不支持最開(kāi)始就配置pl的過(guò)程。
2019-05-15 11:41:317190
ZYNQ開(kāi)發(fā)雙核運(yùn)行原理及過(guò)程
ZYNQ是一個(gè)可擴(kuò)展平臺(tái),就是有FPGA作為外設(shè)的A9雙核處理器,它的啟動(dòng)流程與FPGA完全不同,而與傳統(tǒng)的ARM處理器類(lèi)似,ZYNQ的啟動(dòng)配置需要多個(gè)處理步驟。
2020-12-05 10:48:585388
Zynq UltraScale+ 器件與PL DNA不同的值
Xilinx 用兩個(gè) 96 位獨(dú)特器件標(biāo)識(shí)符(稱(chēng)為器件 DNA)為每個(gè) Zynq UltraScale+ 器件編程。一個(gè) DNA 值位于可編程邏輯 (PL) 中,另一個(gè) DNA 值位于處理系統(tǒng) (PS) 中。這兩個(gè) DNA 值是不同的,但每個(gè) DNA 都有以下屬性及讀取訪(fǎng)問(wèn)方法。
2022-02-08 14:19:491149
Zynq 在非 JTAG 模式下的啟動(dòng)配置流程
初學(xué) Zynq 的時(shí)候,都是按照慣例打開(kāi) Vivado 軟件,然后實(shí)現(xiàn) Zynq 可編程邏輯硬件部分PL的設(shè)置后,把硬件部署導(dǎo)出,再打開(kāi) SDK 進(jìn)行 ARM 核的軟件部分 PS 編程設(shè)計(jì),最后再將
2022-02-08 11:48:371021
Zynq的啟動(dòng)與配置過(guò)程詳解
初學(xué) Zynq 的時(shí)候,都是按照慣例打開(kāi) Vivado 軟件,然后實(shí)現(xiàn) Zynq 可編程邏輯硬件部分PL的設(shè)置后,把硬件部署導(dǎo)出,再打開(kāi) SDK 進(jìn)行 ARM 核的軟件部分 PS 編程設(shè)計(jì),最后再將
2021-01-26 07:30:2920
FPGA、Zynq和Zynq MPSoC三種器件的特點(diǎn)介紹
。如圖2.1所示,在相對(duì)較高層次對(duì)比了三種器件。Zynq MPSoC的PS部分比Zynq的PS部分面積更大,也更復(fù)雜。本章,將介紹這三種器件的特點(diǎn)。 2.1 技術(shù)時(shí)間線(xiàn) 進(jìn)一步介紹之前,需要指出這三種
2021-04-02 17:20:1413783
如何在 Vitis 中調(diào)試 Zynq UltraScale 器件啟動(dòng)鏡像
在本篇博文中,我們將探討如何在 Vitis 中調(diào)試 Zynq UltraScale 器件啟動(dòng)鏡像。這些啟動(dòng)鏡像包括 ARM 可信固件 (ATF) 和 U-boot。 本篇博文乃是系列博文中
2021-06-01 15:35:452709
Zynq-7000 SoC 啟動(dòng)鏡像布局
為處理海量數(shù)據(jù)、復(fù)雜算法、超低延時(shí)的應(yīng)用提供數(shù)字化加速驅(qū)動(dòng)力是賽靈思一直的目標(biāo),為此,賽靈思研發(fā) Bootgen 工具支持將二進(jìn)制文件縫合在一起并生成器件啟動(dòng)鏡像。定義了多個(gè)屬性和參數(shù)作為創(chuàng)建啟動(dòng)
2021-08-27 14:11:302832
FPGA CPLD可編程邏輯器件的在系統(tǒng)配置方法
FPGA CPLD可編程邏輯器件的在系統(tǒng)配置方法(深圳市村田電源技術(shù)有限公司)-FPGA CPLD可編程邏輯器件的在系統(tǒng)配置方法? ? ? ? ? ? ? ? ? ?
2021-09-18 10:51:2013
【Zynq UltraScale+ MPSoC解密學(xué)習(xí)2】Zynq UltraScale+的電源系統(tǒng)
功耗域2.2 低功耗域2.3 全功耗域2.4 PL功耗域2.5 PMU一、電源優(yōu)化方法相對(duì)于上一代Zynq器件,Zynq UltraScale+更加...
2021-11-06 21:06:046
Zynq SDK 驅(qū)動(dòng)探求(五)軟件動(dòng)態(tài)重配置硬件比特流
在 Xilinx Zynq 器件中,硬件可編程邏輯 PL 是作為一項(xiàng)外設(shè)掛載在 ARM 處理器系統(tǒng)中的,那么 PL 硬件的配置自然也就由處理器負(fù)責(zé)。本文...
2022-02-07 11:18:271
ZYNQ的啟動(dòng)流程
ZYNQ7000 SOC 芯片可以從 FLASH 啟動(dòng),也可以從 SD 卡里啟動(dòng), 本節(jié)介紹程序 FLASH 啟動(dòng)的方法。Zynq7000 SOC 芯片上電后,最先運(yùn)行的是ARM端系統(tǒng)(PS
2022-05-07 09:41:355019
ZYNQ 的啟動(dòng)流程介紹
普通的 FPGA 一般是可以從 flash 啟動(dòng),或者被動(dòng)加載,但是ZYNQ不行,ZYNQ必須PS端參與
2022-07-22 10:10:025209
FPGAs,Zynq和Zynq MPSoC器件的特點(diǎn)
Zynq MPSoC是Zynq-7000 SoC(之后簡(jiǎn)稱(chēng)Zynq)的進(jìn)化版本。Zynq是賽靈思發(fā)布的集成PL(FPGA)和PS設(shè)計(jì)的最早的一代產(chǎn)品。如圖2.1所示,在相對(duì)較高層次對(duì)比了三種器件。Zynq MPSoC的PS部分比Zynq的PS部分面積更大,也更復(fù)雜。本章,將介紹這三種器件的特點(diǎn).
2022-08-15 09:16:381629
Zynq在非JTAG模式下的啟動(dòng)配置流程
在無(wú) JTAG 的模式下,Zynq 是通過(guò)片上CPU完成對(duì)芯片的配置,也就是PS和PL的配置是通過(guò) PS 處理器 ARM 核來(lái)實(shí)現(xiàn)的。需要注意的是,與傳統(tǒng)的 Xilinx 7 系列 FPGA 芯片不同,Zynq 是不支持從 PL 端進(jìn)行直接啟動(dòng)配置的,一定要通過(guò) PS 部分來(lái)完成。
2022-10-19 09:11:55986
?在配置FPGA器件時(shí)的常見(jiàn)問(wèn)題及其解決方法
FPGA器件配置方式分三大類(lèi):主動(dòng)配置、被動(dòng)配置和JTAG配置。 主動(dòng)配置:由FPGA器件引導(dǎo)配置操作過(guò)程。 被動(dòng)配置:由計(jì)算機(jī)或控制器控制配置過(guò)程。上電后,控制器件或主控器把存儲(chǔ)在外部存儲(chǔ)器
2022-11-17 12:15:101141
Zynq UltraScale+ RFSoC器件介紹
介紹一下Xilinx公司的新一代Zynq UltraScale+ RFSoC器件,可用于LTE、5G、SDR、衛(wèi)星通信等無(wú)線(xiàn)平臺(tái)。
2023-05-22 10:38:593966
使用JTAG仿真器查看ZYNQ當(dāng)前啟動(dòng)模式
本文介紹使用Xilinx?SDK軟件查看當(dāng)前Zynq?SoC啟動(dòng)模式的步驟
2023-07-07 14:15:001179
軟啟動(dòng)電容配置的計(jì)算實(shí)例
在 “ 什么是軟啟動(dòng)?軟啟動(dòng)時(shí)間?啟動(dòng)時(shí)間?”文章中,我們簡(jiǎn)述了為開(kāi)關(guān)電源配置一個(gè)最小的軟啟動(dòng)時(shí)間,至少可以獲得兩個(gè)好處。
2023-07-23 10:35:061102
Zynq UltraScale+ MPSoC中的隔離方法
電子發(fā)燒友網(wǎng)站提供《Zynq UltraScale+ MPSoC中的隔離方法.pdf》資料免費(fèi)下載
2023-09-13 17:11:481
Zynq-7000 SoC的安全啟動(dòng)應(yīng)用說(shuō)明
電子發(fā)燒友網(wǎng)站提供《Zynq-7000 SoC的安全啟動(dòng)應(yīng)用說(shuō)明.pdf》資料免費(fèi)下載
2023-09-13 11:46:041
Zynq UltraScale+器件封裝和管腳用戶(hù)指南
電子發(fā)燒友網(wǎng)站提供《Zynq UltraScale+器件封裝和管腳用戶(hù)指南.pdf》資料免費(fèi)下載
2023-09-13 10:30:451
基于zynq7020器件來(lái)搭建Linux系統(tǒng)
Zynq器件將arm和FPGA結(jié)合,利用了兩者各自的優(yōu)勢(shì),arm可以實(shí)現(xiàn)靈活的控制,而FPGA部分可以實(shí)現(xiàn)算法加速,這大大擴(kuò)展了zynq的應(yīng)用。比如深度學(xué)習(xí)加速,圖像處理等等。PL側(cè)表示FPGA的邏輯部分,PS側(cè)為arm端以及一些AXI接口控制部分,二者實(shí)際上通過(guò)AXI接口實(shí)現(xiàn)通信和互聯(lián)。
2023-11-09 11:28:041460
評(píng)論
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