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SN65LVDS100 2Gbps LVDS/LVPECL/CML 轉 LVDS 緩沖器/中繼器/轉換器

數據:

描述

SN65LVDS100,SN65LVDT100,SN65LVDS101和SN65LVDT101是連接為中繼器的高速差分接收器和驅動器。接收器接受低壓差分信號(LVDS),正射極耦合邏輯(PECL)或電流模??式邏輯(CML)輸入信號,速率高達2 Gbps,并將其重復為LVDS或PECL輸出信號。通過器件的信號路徑是差分的,用于低輻射發射和最小的附加抖動。

SN65LVDS100和SN65LVDT100的輸出是TIA /EIA-644-A定義的LVDS電平。 SN65LVDS101和SN65LVDT101的輸出與3.3V PECL電平兼容。兩個驅動差分傳輸線的標稱值均為100Ω。

SN65LVDT100和SN65LVDT101包含一個110Ω差分線路終端電阻,可減少電路板空間,減少元件數量,并縮短最短的短截線長度。它們不包括SN65LVDS100和SN65LVDS101中的V BB 電壓參考。 V BB 提供低于V CC 的電壓基準,通常為1.35 V,用于接收單端輸入信號,對于單端3.3 V PECL輸入特別有用。當不使用V BB 時,它應該是未連接或打開的。

所有器件的特點是在-40°C至85°C的溫度范圍內工作。

特性

  • 設計用于≥2Gbps的信令速率
  • 總抖動< 65 ps
  • MC100EP16的低功耗替代方案
  • 低100 ps(最大)器件間偏斜
  • 25 mV接收器輸入閾值滯后
    超過0 V至4 V輸入電壓范圍
  • 輸入電氣兼容LVPECL,
    CML和LVDS信號電平
  • 3.3 V電源操作
  • LVDT集成了110Ω終端電阻
  • 以SOIC和MSOP提供

參數 與其它產品相比?緩沖器、驅動器/接收器和交叉點

?
Device Type
Protocols
No. of Tx
No. of Rx
Input Signal
Output Signal
Signaling Rate (Mbps)
ESD HBM (kV)
Function
Operating Temperature Range (C)
Package Group
Package Size: mm2:W x L (PKG)
Pin/Package
SN65LVDS100 SN65CML100 SN65LVDS101 SN65LVDS17 SN65LVDS18 SN65LVDS19 SN65LVDS20 SN65LVP16 SN65LVP17 SN65LVP18 SN65LVP19 SN65LVP20
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CML
LVDS
LVPECL ? ?
CML
LVDS
LVPECL ? ?
CML
LVDS
LVPECL ? ?
Differential ? ? Single-Ended ? ? Differential ? ? Differential ? ? Single-Ended ? ? Differential ? ? Single-Ended ? ? Differential ? ? Differential ? ?
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SOIC
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SOIC
VSSOP ? ?
SOIC
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8SOIC: 29 mm2: 6 x 4.9(SOIC)
8VSSOP: 15 mm2: 4.9 x 3(VSSOP) ? ?
8SOIC: 29 mm2: 6 x 4.9(SOIC)
8VSSOP: 15 mm2: 4.9 x 3(VSSOP) ? ?
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8SOIC
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8SOIC
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8SOIC
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方框圖 (1)

技術文檔

數據手冊(1)
元器件購買 SN65LVDS100 相關庫存
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