帶引腳控制的 8 通道輸出 1.8V、2.5V 和 3.3V LVDS 緩沖器
| Function | Clock buffer, Differential |
| Additive RMS jitter (Typ) (fs) | 50 |
| Output frequency (Max) (MHz) | 2000 |
| Number of outputs | 8 |
| Output supply voltage (V) | 1.8, 2.5, 3.3 |
| Core supply voltage (V) | 1.8, 2.5, 3.3 |
| Output skew (ps) | 20 |
| Features | 2:8 fanout, Universal inputs, Individual output enable control, Pin control |
| Operating temperature range (C) | -40 to 105 |
| Rating | Catalog |
| Output type | LVDS |
| Input type | HCSL, LP-HCSL, LVCMOS, LVDS, LVPECL |
- 具有 2 路輸入和 8 路輸出 (2:8) 的高性能 LVDS 時鐘緩沖器系列
- 輸出頻率最高可達 2GHz
- 通過硬件引腳實現啟用/禁用獨立輸出
- 電源電壓：1.8V/2.5V/3.3V ± 5%
- 低附加抖動：156.25MHz 下小于 12kHz 至 20MHz 范圍內的 60fs rms 最大值
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超低相位本底噪聲：-164dBc/Hz（典型值）
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超低傳播延遲：< 575ps（最大值）
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輸出延遲：20ps（最大值）
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失效防護輸入
- 通用輸入接受 LVDS、LVPECL、LVCMOS、HCSL 和 CML
- LVDS 基準電壓 (VAC_REF) 適用于容性耦合輸入
- 工業溫度范圍：–40°C 至 105°C
- 可用封裝：
- 6mm × 6mm 40 引腳 VQFN (RHA)
LMK1D1208P 時鐘緩沖器將兩個中的任何一個可選時鐘輸入（IN0 和 IN1）分配給 8 對差分 LVDS 時鐘輸出（OUT0 至 OUT7），通過超小延遲實現時鐘分配。輸入可以為 LVDS、LVPECL、LVCMOS、HCSL 或 CML。
LMK1D1208P 專為驅動 50? 傳輸線路而設計。在單端模式下驅動輸入時，對未使用的負輸入引腳施加適當的偏置電壓（請參閱Figure 8-6）。IN_SEL 引腳用于選擇要發送到輸出的輸入。該器件支持失效防護輸入功能。該器件還整合了輸入遲滯，可防止在沒有輸入信號的情況下輸出隨機振蕩。
各個 LVDS 差分輸出均可通過將對應的 OEx 引腳設置為邏輯高電平“1”來實現。如果此引腳設置為邏輯低電平“0”，輸出將被禁用，呈現高阻態，從而降低功耗。
該器件可在 1.8V、2.5V 或 3.3V 電源環境下工作，額定溫度范圍是 –40°C 至 105°C（環境溫度）。
