AD6641是一款250 MHz帶寬數字預失真(DPD)觀測接收機，集成一個12位500 MSPS ADC、一個16k × 12 FIFO和一個多模式后端，用戶可通過串行端口(SPORT)、SPI接口、12位并行CMOS端口或6位DDR LVDS端口檢索存儲在集成FIFO存儲器中的數據。它具有出色的動態性能和低功耗特性，適合電信應用，如要求更寬帶寬的數字預失真觀測路徑等。芯片上集成了全部必需功能，包括采樣保持器與基準電壓源，可提供完整的信號轉換解決方案。
片內FIFO允許通過ADC捕捉較短的時間快照，以及以較低速率進行回讀。這樣，捕捉的數據可以隨時以低得多的采樣速率進行傳輸，信號處理限制得以降低。FIFO可以在多種用戶可編程模式下工作。在單次捕捉模式下，當捕捉到ADC數據時，可以通過SPI端口或者使用外部FILL±引腳來指示。在連續捕捉模式下，數據持續加載到FIFO中，并使用FILL±引腳停止該操作。
FIFO中存儲的數據可以在多種用戶可選的輸出模式下回讀。可以置位DUMP引腳以輸出FIFO數據。FIFO中存儲的數據可以通過SPORT、SPI、12位并行CMOS端口或6位DDR LVDS接口訪問。AD6641在12位CMOS或6位DDR LVDS模式下支持最大輸出吞吐速率，器件內部將其限制為最大輸入采樣速率的1/8。也就是說，當輸入時鐘速率為500 MSPS時，最大輸出數據速率為62.5 MHz。
該ADC要求采用1.9 V模擬電源供電及差分時鐘信號，以便充分發揮其工作性能。輸出格式選項包括二進制補碼、偏移二進制和格雷碼。該ADC還提供數據時鐘輸出，用于正確進行輸出數據定時。該器件采用先進的SiGe BiCMOS工藝制造，提供56引腳LFCSP封裝，額定溫度范圍為-40°C至+85°C工業溫度范圍。該產品受美國專利保護。
應用
- 無線和有線寬帶通信
- 通信測試設備
- 功率放大器線性化
產品特色
- 高性能ADC內核。
500 MSPS、250 MHz輸入時信噪比維持在65.8 dBFS。 - 低功耗。500 MSPS時功耗僅695 mW。
- 易于使用。
片內16k FIFO允許用戶讓高性能ADC在目標時間執行處理，并在任意時間以較低的采樣速率傳輸數據，從而減少數據處理的限制。片內基準電壓源和采樣保持功能使系統設計更靈活。采用1.9 V單電源則簡化了系統電源設計。 - 串行端口控制。
標準串行端口接口支持對器件進行配置以及根據用戶的需求進行定制。 - 1.9 V或3.3 V SPI和串行數據端口工作模式。
- 信噪比(SNR)：65.8 dBFS（fIN最高為250MHz，500 MSPS）
- 有效位數(ENOB)：10.5位（fIN最高為250 MHz，500 MSPS，?1.0 dBFS）
- 無雜散動態范圍(SFDR)：80 dBc（fIN最高為250 MHz，500 MSPS，?1.0 dBFS）
- 出色的線性度
- DNL = ±0.5 LSB（典型值）；INL = ±0.6 LSB（典型值）
- 集成16k × 12 FIFO
- FIFO回讀選項
- 12位并行CMOS（62.5 MHz）
- 6位DDR LVDS接口
- SPORT (62.5 MHz)
- SPI (25 MHz)
- 高速同步功能
- 1 GHz全功率模擬帶寬
- 集成輸入緩沖器
- 片內基準電壓源，無需外部去耦
- 低功耗
- 695 mW (500 MSPS)
- 可編程輸入電壓范圍
- 1.18 V至1.6 V，標稱值1.5 V
- 采用1.9 V模擬和數字電源供電
- 1.9 V或3.3 V SPI和SPORT工作模式
- 時鐘占空比穩定器
- 帶可編程時鐘和數據對準功能的集成數據時鐘輸出
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