ADRF6602是一款高動態范圍有源混頻器，集成PLL和VCO。PLL/頻率合成器利用小數N分頻PLL產生FLO輸入，供給混頻器。基準輸入可以進行分頻或倍頻，然后施加于PLL鑒相器。PLL支持12 MHz至160 MHz范圍內的輸入基準頻率。鑒相器輸出控制一個電荷泵，其輸出在片外環路濾波器中進行積分。然后，環路濾波器輸出施加于一個集成式VCO。VCO輸出(2*FLO)再施加于一個LO分頻器和一個可編程PLL分頻器。
可編程分頻器由一個Σ-Δ調制器(SDM)進行控制。SDM的模數可以在2至2047范圍內編程。
有源混頻器可將單端50 Ω RF輸入轉換為200 Ω差分IF輸出。IF輸出的工作頻率最高可達500 MHz。
ADRF6602采用先進的硅-鍺BiCMOS工藝制造，提供40引腳、裸露焊盤、無鉛、6 mm × 6 mm LFCSP封裝，額定溫度范圍為?40°C至+85°C。
應用
- 蜂窩基站
- 集成小數N分頻PLL的接收混頻器
- RF輸入頻率范圍：1000 MHz至3100 MHz
- 內部LO頻率范圍：1550 MHz至2150 MHz
- 輸入P1dB：+12 dBm
- 輸入IP3：+29 dBm
- 通過外部引腳優化IP3
- SSB噪聲系數：12 dB
- 電壓轉換增益：6 dB
- 200 Ω IF輸出匹配阻抗
- IF 3 dB帶寬：500 MHz
- 可通過三線式SPI接口進行編程
- 40引腳6 mm × 6 mm LFCSP封裝
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