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在很多通信芯片及系統的開發中，常常需要用到存儲容量大、讀寫速度快的存儲器。在各種隨機存儲器件中，SDRAM的價格低、體積小、速度快、容量大，是比較理想的器件。但是，與SRAM相比較，SDRAM的控制邏輯復雜，接口方式與普通的存儲器差異很大。為了解決這個矛盾，需要設計專用的SDRAM控制器，使用戶像使用SRAM -樣方便的使用SDRAM。考慮到控制器的通用性，本文中提出了一種通用的SDRAM控制器的FPGA設計，FPGA內部采用狀態機的方式。該設計采用了AD公司的DSP處理芯片TS - 101作為主控系統。TS - 101雖然能直接訪問SDRAM，但容量有限。這里將其外部SDRAM存儲容量擴展到512Mbyte，使用的是TS - 101的主機（/MSH）空間，這是一個SRAM型的接口空間。在此設計系統中TS-IOI的系統時鐘以及FPGA和SDRAM的時鐘均為50MHz。
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