如何解決電網(wǎng)三相電壓不平衡時(shí)傳統(tǒng)鎖相環(huán)不能準(zhǔn)確檢測(cè)基波正序相位的問題
資料介紹
針對(duì)在電網(wǎng)三相電壓不平衡時(shí)傳統(tǒng)鎖相環(huán)不能準(zhǔn)確檢測(cè)基波正序相位的問題,設(shè)計(jì)了一種雙正弦幅值積分器解耦鎖相環(huán)(decoupled double sinusoidal amplitude integrator phase-locked loop, DDSAI-PLL)。該鎖相環(huán)利用正弦幅值積分器的頻率選擇特性,在αβ 坐標(biāo)系下采用正負(fù)序解耦結(jié)構(gòu)實(shí)現(xiàn)了正序分量的完全提取。同時(shí)引入一階負(fù)反饋系統(tǒng)作為頻率自適應(yīng)環(huán)節(jié),使鎖相環(huán)在電網(wǎng)頻率發(fā)生偏移時(shí)仍然可以對(duì)基波正序頻率進(jìn)行準(zhǔn)確估計(jì)。建立了DDSAI-PLL 的數(shù)學(xué)模型,并對(duì)其關(guān)鍵參數(shù)進(jìn)行了設(shè)計(jì)。最后使用DSP 實(shí)現(xiàn)該鎖相環(huán),并在電壓畸變條件下與傳統(tǒng)的同步參考坐標(biāo)系鎖相環(huán)(SRF-PLL)進(jìn)行了對(duì)比實(shí)驗(yàn),結(jié)果證明了所提鎖相方法的有效性。
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