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本設計運用了基于Nios II 嵌入式處理器的SOPC 技術。系統以ALTERA
公司的Cyclone 系列FPGA 為數字平臺，將微處理器、總線、數字頻率合成器、
存儲器和I/O 接口等硬件設備集中在一片FPGA 上，利用直接數字頻率合成
（DDFS）技術、數字調制技術實現所要求波形的產生，用FPGA 中的ROM 儲
存DDS 所需的波形表，充分利用片上資源，提高了系統的精確度、穩定性和抗
干擾性能。使用新的數字信號處理（DSP）技術，通過在Nios 中軟件編程解決
不同的調制方式的實現和選擇。系統頻率實現1Hz～20MHz 可調，步進達到了
1Hz；完成了調幅、調頻、二進制PSK、二進制ASK、二進制FSK 調制和掃頻
輸出的功能。
公司的Cyclone 系列FPGA 為數字平臺，將微處理器、總線、數字頻率合成器、
存儲器和I/O 接口等硬件設備集中在一片FPGA 上，利用直接數字頻率合成
（DDFS）技術、數字調制技術實現所要求波形的產生，用FPGA 中的ROM 儲
存DDS 所需的波形表，充分利用片上資源，提高了系統的精確度、穩定性和抗
干擾性能。使用新的數字信號處理（DSP）技術，通過在Nios 中軟件編程解決
不同的調制方式的實現和選擇。系統頻率實現1Hz～20MHz 可調，步進達到了
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