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對ASIC設計進行FPGA原型驗證時,由于物理結(jié)構不同,ASIC的代碼必須進行一定的轉(zhuǎn)換后才能作為FPGA的輸入。
現(xiàn)代集成電路設計中,芯片的規(guī)模和復雜度正呈指數(shù)增加。尤其在ASIC設計流程中,驗證和調(diào)試所花的時間約占總工期的70%。為了縮短驗證周期,在傳統(tǒng)的仿真驗證的基礎上,涌現(xiàn)了許多新的驗證手段,如斷言驗證、覆蓋率驅(qū)動的驗證,以及廣泛應用的基于現(xiàn)場可編程器件(FPGA)的原型驗證技術。
采用FPGA原型技術驗證ASIC設計,首先需要把ASIC設計轉(zhuǎn)化為FPGA設計。但ASIC是基于標準單元庫,FPGA則是基于查找表,ASIC和FPGA物理結(jié)構上的不同,決定了ASIC代碼需要一定的修改才能移植到FPGA上。但應該注意到這只是由于物理結(jié)構不同而對代碼進行的轉(zhuǎn)換,并不改變其功能,因此對代碼的這種修改只能限制在一定范圍內(nèi)。
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