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基于電源模塊、外部存儲器和FPGA 器件等具體分析了融合系統(tǒng)的低功耗設(shè)計。FPGA 器件選擇了Xilinx 公司針對高性能信號處理的Virtex24 SX35 三百萬門級芯片,電源模塊采用TI 公司的兩片TPS54310 和一片TPS54610 ,具有低功耗特性,電壓調(diào)節(jié)范圍為0. 9～3. 3 V ,調(diào)節(jié)精度可達(dá)1 %。外部存儲器使用高速、低功耗的ZBT SRAM 存儲器,消除了標(biāo)準(zhǔn)SRAM 器件存在的讀和寫周期間的等待狀態(tài)和空閑周期,該功能可極大地改善存儲器性能,在存在頻繁的讀/寫操作變換時效果更佳。結(jié)合圖像融合算法的特點(diǎn)和Virtex24 SX系列FPGA 的資源與技術(shù)優(yōu)勢,討論了在總線編碼、流水線設(shè)計和并行處理等方面的低功耗設(shè)計方法。結(jié)果顯示:采用此技術(shù)設(shè)計的融合系統(tǒng)有效降低了系統(tǒng)的實(shí)際功耗,其動態(tài)功耗降幅可達(dá)50 % ,為提高融合系統(tǒng)的可靠性提供了有力支持。
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