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發(fā)視頻電子系統(tǒng)設(shè)計(jì)實(shí)驗(yàn)指導(dǎo)書（FPGA基礎(chǔ)篇_Vivado版）.PDF
2016-07-25 |
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資料介紹
本指導(dǎo)書由東南大學(xué)電子科學(xué)與工程學(xué)院編著。 一、 實(shí)驗(yàn)?zāi)康?1． 熟悉 Vivado 2014.2 的編譯環(huán)境； 2． 了解在 Vivado 2014.2 環(huán)境下運(yùn)用 Verilog HDL 語言的編程開發(fā)流程，包括源程序的輸入、編譯、模擬仿真及程序下載。 二、 實(shí)驗(yàn)內(nèi)容 1. 簡單門電路的實(shí)現(xiàn)； 2. 三態(tài)門電路。 三、 實(shí)驗(yàn)要求 1. 在 Vivado 2014.2 環(huán)境下完成對(duì)電路工作。
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