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電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>針對功率設(shè)計(jì)SDR的整體方法簡析

針對功率設(shè)計(jì)SDR的整體方法簡析

2017-11-06 | rar | 0.4 MB | 次下載 | 1積分

資料介紹

傳統(tǒng)上,降低軟件無線電(SDR)硬件的功耗一直是我們工作的重點(diǎn),但是,顯而易見軟件也有重要影響,因此,需要一種降低SDR功耗的整體設(shè)計(jì)方法。一種能發(fā)揮SDR功能的測試床能幫我們解決這個(gè)問題。
  由于像美國聯(lián)合戰(zhàn)術(shù)無線電系統(tǒng)(JTRS)這樣的計(jì)劃,軟件定義的無線電(SDR)早已被證實(shí)。然而,有許多問題嚴(yán)重地制約著SDR的廣泛部署,其中相當(dāng)重要的問題就是功率。
  功率是在設(shè)計(jì)每一個(gè)SDR子系統(tǒng)時(shí)的主要考慮因素,特別是因?yàn)樗鼈円谋扔布o線電更多的功率。例如,為了獲得預(yù)期的無線電通信距離(依賴于鏈路的狀況,典型值為5-10千米數(shù)量級),射頻RF)前端必須具備足夠的發(fā)射功率。同樣,對于靠電池工作的無線電設(shè)備,RF前端、調(diào)制解調(diào)器和加密處理子系統(tǒng)的功耗都直接影響無線電設(shè)備的壽命。此外,對由調(diào)制解調(diào)器產(chǎn)生的熱量進(jìn)行散熱的能力直接影響到無線電設(shè)備的壽命,并且甚至可能影響到能在機(jī)箱中同時(shí)處理的通道數(shù),且有更多的影響。
  因此,降低一個(gè)SDR的功率有許多好處,這些好處可能甚至包括通過購買更少的備用電池而降低運(yùn)營費(fèi)用。在此,為了獲得其中的一些好處,我們談?wù)摰闹攸c(diǎn)將放在降低SDR調(diào)制解調(diào)器功耗的整體方法上。
  為了降低調(diào)制解調(diào)器中的功耗,大多數(shù)人首先注意的就是在處理過程中的硬件,其中,通常包含現(xiàn)場可編程門陣列(FPGA)、數(shù)字信號處理器DSP)和通用目的處理器(GPP)。區(qū)分任何硬件器件的兩個(gè)功耗源——靜態(tài)功耗和動(dòng)態(tài)功耗——是至關(guān)重要的。靜態(tài)功耗是一個(gè)已加電但不活躍的器件所消耗的固有功率,由晶體管電流泄漏所控制。另一方面,動(dòng)態(tài)功耗是由活躍使用的器件所消耗的功率,該功率受到若干變量的影響,包括電源電壓、對外部存儲器的訪問次數(shù)、數(shù)據(jù)帶寬,等等。檢測兩種類型的功耗是至關(guān)重要的,特別是在無線電設(shè)備具有一個(gè)通常接收比發(fā)射更長的占空周期的情形下。在GPP和甚至DSP的情形下,像頻率調(diào)節(jié)、電壓調(diào)節(jié)和電源關(guān)閉模式這樣的電源管理功能已經(jīng)變得日益普遍。然而,關(guān)于FPGA又是什么情況呢?
  針對功率設(shè)計(jì)SDR的整體方法簡析
  圖1:用于降低SDR功耗的一種真正的整體方法要采用來自每一個(gè)象限的多種技術(shù)。
  有許多方法可以用來降低FPGA中的靜態(tài)或動(dòng)態(tài)功耗,其中許多方法不是可以同時(shí)應(yīng)用的。一些降低靜態(tài)功耗的方法包括三極柵氧化層電源門控。
  利用三極柵氧化層,硅供應(yīng)商在晶體管上覆蓋一層氧化層以減少泄漏;覆蓋層越厚,泄漏就越小。性能保持平衡。在內(nèi)核中需要性能的地方,常見的就是采用薄的氧化層;而對于驅(qū)動(dòng)較高電壓的I/O,要采用厚的氧化層。在不需要最大性能的地方,如配置SRAM,附加的中間氧化層可以極大地降低泄漏。利用這種技術(shù)的FPGA的例子包括賽靈思的Virtex-4和Virtex-5系列。
  針對功率設(shè)計(jì)SDR的整體方法簡析
  圖2:帶有功率測量值的基于模型設(shè)計(jì)流程可以簡化對波形劃分的決策。
  當(dāng)FPGA模塊未被使用時(shí),電源門控涉及晶體管的使用以降低待機(jī)泄漏。這種技術(shù)的一個(gè)例子可以在低功耗睡眠模式中看到。例如,如果在一個(gè)FPGA中的所有模塊都被電源門控,該器件就消耗非常小的靜態(tài)功耗。在這種情形下,平衡的是FPGA的配置的損耗,以便該器件在喚醒過程期間被完全地重配置,這個(gè)過程可能要花幾毫秒。另一方面,除了那些具有配置的模塊(比如配置存儲器)之外,如果所有的模塊都被電源門控,那么,F(xiàn)PGA的狀態(tài)就被保持住了。盡管喚醒時(shí)間被極大地縮短了,但是,所節(jié)省的功率遠(yuǎn)遠(yuǎn)不如當(dāng)所有模塊都被電源門控時(shí)那樣顯著。賽靈思的Spartan-3A系列的FPGA支持兩種類型的電源門控。
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