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為提高處理能力，設(shè)計了2×2并行流水結(jié)構(gòu)的FPGA矩陣并作為處理核心用于高速數(shù)據(jù)采集與控制。在分析了多片F(xiàn)PGA的同步驅(qū)動原理以及協(xié)作模型的基礎(chǔ)上，綜合利用雙時鐘沿觸發(fā)傳輸、資源重復(fù)與時間重疊技術(shù)提出了FPGA之間以及FPGA與外圍A／D和D／A芯片的數(shù)據(jù)傳輸方案。最后揭示了光纖通信驅(qū)動的數(shù)據(jù)采集與控制過程及總線沖突解決策略。所設(shè)計的系統(tǒng)具有成本低、靈活性強的特點，實驗表明該系統(tǒng)能夠滿足可靠性和實時性要求。
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