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發(fā)視頻FPGA視頻教程之為什么Verilog能支持大型設(shè)計(jì)的詳細(xì)資料說(shuō)明
2019-03-27 |
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資料介紹
為什么Verilog能支持大型設(shè)計(jì)
Verilog語(yǔ)法支持多層次多模塊設(shè)計(jì)：-用、include宏指令可以在一個(gè)模塊中包含多個(gè)模塊;
在一個(gè)模塊中可以用實(shí)例調(diào)用別的模塊中定義的電路結(jié)構(gòu)，構(gòu)成多層次模塊：
在一個(gè)模塊中可以用多個(gè)任務(wù)和函數(shù)來(lái)表達(dá)復(fù)雜的狀態(tài)機(jī)和結(jié)構(gòu);
一個(gè)設(shè)計(jì)項(xiàng)目往往由一個(gè)頂層測(cè)試模塊和多個(gè)可綜合模塊和若千個(gè)外圍接口模塊構(gòu)成。
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