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一、填空題
1. 用EDA 技術進行電子系統設計的目標是最終完成ASIC 的設計與實現。
3. 隨著EDA 技術的不斷完善與成熟， 自頂向下的設計方法更多的被應用于Verilog HDL設計當中。
4. 目前國際上較大的PLD 器件制造公司有ALtera 和Xilinx 公司。
5. 完整的條件語句將產生組合電路，不完整的條件語句將產生時序電路。
6. 阻塞性賦值符號為= ，非阻塞性賦值符號為《= 。
7．有限狀態機分為Moore 和Mealy 兩種類型。
8、EDA 縮寫的含義為電子設計自動化（Electronic Design Automation）
9．狀態機常用狀態編碼有二進制、格雷碼和獨熱碼。
10． Verilog HDL 中任務可以調用其他任務和函數。
11．系統函數和任務函數的首字符標志為$ ，預編譯指令首字符標志為# 。
12．可編程邏輯器件的優化過程主要是對速度和資源的處理過程。
13、大型數字邏輯電路設計采用的IP 核有軟IP、固IP 和硬IP。
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