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在Xilinx的FPGA中，時鐘網絡資源分為兩大類：全局時鐘資源和區域時鐘資源。
全局時鐘資源是一種專用互連網絡，它可以降低時鐘歪斜、占空比失真和功耗，提高抖動容限。Xilinx的全局時鐘資源設計了專用時鐘緩沖與驅動結構，從而使全局時鐘到達CLB、IOB和BRAM的延時最小。
區域時鐘資源是獨立于全局時鐘網絡的。Xilinx的器件分成若干個時鐘區域，以Virtex-6為例，Virtex-6的最小器件有6個區域，最大器件有18個區域。它與全局時鐘不同，區域時鐘信號X只能驅動限定的時鐘區域。
這里面提到區域時鐘的概念，需要解釋一下。Xilinx的FPGA器件是通過時鐘區域來管理時鐘網絡的，以Virtex-6為例，時鐘區域的大小固定為40個CLB 高，半個晶片寬。因此大尺寸的器件有更多的時鐘區域。如下圖所示，下圖中的FPGA器件一共包含6個時鐘區域，左側三個右側三個，從圖可以看出每個區域高度是2*20CLBs，區域寬度是半個FPGA芯片的寬度。中間是CMT時鐘管理模塊。
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