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FPGA在電平接口領(lǐng)域有什么樣的應(yīng)用

2021-01-06 | rar | 0.05 MB | 次下載 | 免費(fèi)

資料介紹

  電子技術(shù)的發(fā)展,產(chǎn)生了各種各樣的電平接口

  TTL電平:

  TTL電平信號(hào)之所以被廣泛使用,原因是因?yàn)椋和ǔN覀儾捎枚M(jìn)制來(lái)表示數(shù)據(jù)。而且規(guī)定,+5V等價(jià)于邏輯“1”,0V等價(jià)于邏輯“0”。這樣的數(shù)據(jù)通信及電平規(guī)定方式,被稱(chēng)做TTL(晶體管-晶體管邏輯電平)信號(hào)系統(tǒng)。這是計(jì)算機(jī)處理器控制的設(shè)備內(nèi)部各部分之間通信的標(biāo)準(zhǔn)技術(shù)。

  CMOS電平:

  CMOS電平邏輯電平電壓接近于電源電壓,0 邏輯電平接近于 0V。而且具有很寬的噪聲容限。

  CMOS電路由于輸入太大的電流,內(nèi)部的電流急劇增大,除非切斷電源,電流一直在增大。這種效應(yīng)就是鎖定效應(yīng)。當(dāng)產(chǎn)生鎖定效應(yīng)時(shí),COMS的內(nèi)部電流能達(dá)到40mA以上,很容易燒毀芯片

  防御措施:

  在輸入端和輸出端加鉗位電路,使輸入和輸出不超過(guò)規(guī)定電壓。

  芯片的電源輸入端加去耦電路,防止VDD端出現(xiàn)瞬間的高壓。

  在VDD和外電源之間加限流電阻,即使有大的電流也不讓它進(jìn)去。

  當(dāng)系統(tǒng)由幾個(gè)電源分別供電時(shí),開(kāi)關(guān)要按下列順序:開(kāi)啟時(shí),先開(kāi)啟 CMOS電路的電源,再開(kāi)啟輸入信號(hào)和負(fù)載的電源;關(guān)閉時(shí),先關(guān)閉輸 入信號(hào)和負(fù)載的電源,再關(guān)閉CMOS 電路的電源。

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