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      電子發(fā)燒友網(wǎng)>電子資料下載>模擬數(shù)字>CMOS工藝中GG—NMOS結(jié)構(gòu)ESD保護(hù)電路設(shè)計(jì)

      CMOS工藝中GG—NMOS結(jié)構(gòu)ESD保護(hù)電路設(shè)計(jì)

      2010-05-08 | rar | 190 | 次下載 | 5積分

      資料介紹

      摘要：采用GG-NMOS結(jié)構(gòu)的ESD保護(hù)電路的工作原理和對其進(jìn)行的ESD實(shí)驗(yàn)，提出了一種保護(hù)電路的柵耦合技術(shù)方案，并達(dá)到了預(yù)期效果．通過實(shí)驗(yàn)可以看出其性能達(dá)到了人體放電模式的2級標(biāo)準(zhǔn)．在模擬的基礎(chǔ)上可確定損傷的機(jī)理和位置，從而給出了由ESD導(dǎo)致的柵氧化層損傷的微觀機(jī)制．
      關(guān)鍵詞：ESD；GG-NMOS；人體放電模式；柵耦合
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