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當(dāng)今的計(jì)算機(jī)、PAD、手機(jī)、通信系統(tǒng)設(shè)備等電子產(chǎn)品，處理速度越來(lái)越快，運(yùn)算能力越來(lái)越強(qiáng)，其電源的設(shè)計(jì)也越來(lái)越復(fù)雜。進(jìn)入21世紀(jì)后，芯片的制作工藝由0.18um逐步升級(jí)到了95nm、65nm、45nm，晶體管的集成度更高、主頻更高、供電電壓更低，這給產(chǎn)品的電路設(shè)計(jì)與調(diào)試帶來(lái)了更大的挑戰(zhàn)。在90年代，芯片的供電通常是5V和3.3V，使用CMOS或TTL電平，而現(xiàn)在，很多數(shù)字電路芯片的核心電壓以及IO電平都小于3.3V，以最常用的內(nèi)存芯片為例，最古老的SDR SDRAM供電電壓為3.3V，DDR SDRAM為2.5V，DDR2為1.8V，DDR3為1.5V，而最新的DDR4的供電電壓為1.2V，其VREF只有0.6V。這些電路的供電電壓越來(lái)越小，對(duì)電源噪聲的要求也更加嚴(yán)格，如何設(shè)計(jì)低噪聲的電源、并且準(zhǔn)確測(cè)量其電源噪聲非常關(guān)鍵，本文將從電源完整性（Power Integrity，簡(jiǎn)稱PI）的角度，簡(jiǎn)要分析電源噪聲測(cè)試中可能遇到的問(wèn)題和相應(yīng)的解決方法。
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