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隨著信息技術的飛速發展，電源管理產品的應用越來越廣泛，LDO（Low DropoutRegulator，LDO）產品以其獨特的優勢被大量使用，例如高的電源抑制比，低的待機功耗，低的Dropout電壓，低的輸出噪聲，以及非常少的外圍器件等等，特別在便攜類產品方向，具有很高的研究價值。
本文先簡要介紹了LDO電路的系統架構，然后分析了LDO芯片的主要性能指標：Dropout電壓、線性調整率、電源抑制比、負載調整率與瞬態響應：然后重點介紹了已有的提高LDO電路PSRR的設計，以及系統環路的小信號建模的方法：最后根據介紹的方法，提出了一種高PSRR帶隙基準電路的設計，以及利用一種新穎的動態補償的方法實現環路穩定性的設計。本文主要對LDO電路的各子模塊：快速啟動電路，帶隙基準電路，驅動電路，電壓反饋環路以及過溫與過流電路進行了設計與分析，并使用Cadence公司的仿真工具Spectre進行了電路的仿真驗證，并使用Cadence的布局布線工具Virtuoso進行了版圖的設計。
本文采用華潤上華的0.5um CMOS（Complementary Metal-Oxide Semiconductor）工藝平臺上進行了工程批試產，經過樣品測試，低頻下芯片的電源抑制比可以達到70dB以上，同時在空載到重載范圍內工作穩定，且具有良好的動態響應，可以在多種應用上取代國外廠商的同類芯片，為系統產品降低了成本，帶來了較好的經濟效益。
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