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AD9523提供低功耗、多路輸出時鐘分配功能，具有低抖動
性能，還配有片內(nèi)集成鎖相環(huán)(PLL)和電壓控制振蕩器
(VCO)。片內(nèi)VCO的調(diào)諧頻率范圍為3.6 GHz至4.0 GHz。
AD9523旨在滿足長期演進(LTE)和多載波GSM基站設計的
時鐘要求。它依靠外部VCXO清除參考抖動，以滿足嚴格
的低相位噪聲要求，從而獲得可接受的數(shù)據(jù)轉(zhuǎn)換器信噪比
(SNR)性能。
輸入接收器、振蕩器和零延遲接收器支持單端和差分兩種
操作。當連接系統(tǒng)參考時鐘恢復輸入及外部VCXO，器件
產(chǎn)生1 MHz至1 GHz范圍內(nèi)的14路低噪聲輸出，以及一路來
自輸入PLL(PLL1)的專用緩沖輸出。一路時鐘輸出相對于
另一路時鐘輸出的頻率和相位可通過分頻器相位選擇功能
改變，該功能用作無抖動的時序粗調(diào)，其調(diào)整增量相當于
VCO輸出信號的半個周期。
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