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晶振電源電路及PCB設(shè)計(jì)要點(diǎn)資料下載

2021-03-28 | pdf | 140.53KB | 次下載 | 5積分

資料介紹



原理圖設(shè)計(jì)要點(diǎn):

(1)、晶振電源去耦非常重要,建議加磁珠,去耦電容選兩到三個,容值遞減。

(2)、時鐘輸出管腳加匹配,具體匹配阻值,可根據(jù)測試結(jié)果而定。

(3)、預(yù)留的電容C1,容值要小,構(gòu)成了一級低通濾波,電阻、電容的選擇,根據(jù)具體測試結(jié)果而定。


PCB設(shè)計(jì)要點(diǎn):

(1)、在PCB設(shè)計(jì)是,晶振的外殼必須接地,可以防止晶振的向往輻射,也可以屏蔽外來的干擾。

(2)、晶振下面要鋪地,可以防止干擾其他層。因?yàn)橛行┤嗽诓级鄬影宓臅r候,頂層和底層不鋪地,但是建議晶振所在那一塊鋪上地。

(3)、晶振底下不要布線,周圍5mm的范圍內(nèi)不要布線和其他元器件(有的書是建議300mil范圍內(nèi),大家可以參考),主要是防止晶振干擾其他布線和器件。

(4)、晶振不要布在板子的邊緣,因?yàn)闉榱税踩紤],板卡的地和金屬外殼或者機(jī)械結(jié)構(gòu)常常是連在一起的,這個地我們暫且叫做參考接地板,如果晶振布在板卡的邊緣,晶振與參考接地板會形成電場分布,而板卡的邊緣常常是有很多線纜,當(dāng)線纜穿過晶振和參考接地板的電場是,線纜被干擾了。而晶振布在離邊緣遠(yuǎn)的地方,晶振與參考接地板的電場分布被PCB板的GND分割了,分布到參考接地板電場大大減小了。

(5)、當(dāng)然時鐘線盡量要短。如果你不想讓時鐘線走一路干擾一路,那就布短吧。還有一點(diǎn),關(guān)于晶振的選擇,如果你的系統(tǒng)能工作在25M,就盡量不要選50M的晶振。時鐘頻率高,是高速電路,時鐘上升沿陡也是高速電路,需要考慮信號完整性。


來源:硬十

(mbbeetchina)
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