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      用于千兆位收發(fā)器應(yīng)用的全數(shù)字VCXO替代方案(UltraScale FPGA)

      2023-09-14 | pdf | 1.27 MB | 次下載 | 2積分

      資料介紹

      本應(yīng)用筆記提供了一個(gè)系統(tǒng)，旨在利用每個(gè)串行千兆位收發(fā)器中的功能來(lái)取代外部壓控晶體振蕩器（VCXO）電路。
      常見(jiàn)的設(shè)計(jì)要求是將收發(fā)器輸出的頻率或相位鎖定到輸入端源（稱為循環(huán)、恢復(fù)或從定時(shí)）。傳統(tǒng)上，外部時(shí)鐘清潔器件或VCXO和PLL元件用于為以下目標(biāo)提供高質(zhì)量的時(shí)鐘基準(zhǔn)收發(fā)器，因?yàn)榛?a href='http://m.xsypw.cn/soft/data/30-91/' target='_blank' class='arckwlink_none'>FPGA邏輯的時(shí)鐘通常噪聲太大。雖然有效，但外部時(shí)鐘組件的功耗和成本損失是累加的，因?yàn)槊總€(gè)單獨(dú)的時(shí)鐘通道已生成。當(dāng)使用多個(gè)通道或在低成本系統(tǒng)中時(shí)，成本可能是重要。此外，添加許多外部時(shí)鐘源提供了更多機(jī)會(huì)板級(jí)串?dāng)_和干擾。
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