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在20世紀(jì)70年代和80年代，高速混合信號(hào)設(shè)計(jì)經(jīng)常受到數(shù)字電路而非模擬電路的限制。例如，ADI公司(NYSE: ADI)等業(yè)界領(lǐng)先公司自20世紀(jì)70年代以來(lái)就推出了高速并行轉(zhuǎn)換器(> 10MSPS)，越來(lái)越多的應(yīng)用要求密集的實(shí)時(shí)算法。此外，模數(shù)轉(zhuǎn)換器(ADC)和數(shù)模轉(zhuǎn)換器(DAC)均可提供更高的采樣速率(14位，大于50MSPS)。這些因素要求更快的可編程通用(GP)數(shù)字信號(hào)處理器(DSP)來(lái)應(yīng)對(duì)這些高速設(shè)計(jì)帶來(lái)的挑戰(zhàn)。直到最近，大多數(shù)設(shè)計(jì)人員還被迫將高速并行轉(zhuǎn)換器與專(zhuān)用集成電路(ASICs)或快速現(xiàn)場(chǎng)可編程門(mén)陣列(FPGAs)接口。像這樣的設(shè)備能夠解決許多需要同時(shí)并行進(jìn)行的數(shù)字運(yùn)算，但通常不夠靈活，而且價(jià)格昂貴。
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