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發(fā)視頻SPI接口的應(yīng)用與基于FPGA的SPI自動(dòng)發(fā)送模塊設(shè)計(jì)
資料介紹
SPI 接口應(yīng)用十分廣泛，在很多情況下，人們會(huì)用軟件模擬的方法來(lái)產(chǎn)生SPI 時(shí)序或是采用帶SPI 功能模塊的MCU。但隨著可編程邏輯技術(shù)的發(fā)展，人們往往需要自己設(shè)計(jì)簡(jiǎn)單的SPI 發(fā)送模塊。本文介紹一種基于FPGA 的將并行數(shù)據(jù)以SPI 串行方式自動(dòng)發(fā)送出去的方法。
二、關(guān)鍵字：
VHDL、FPGA、SPI、串行數(shù)據(jù)輸出選擇模塊、移位脈沖產(chǎn)生模塊、SPI 時(shí)鐘采集信號(hào)和無(wú)相移的SPI 基準(zhǔn)時(shí)鐘產(chǎn)生模塊、SPI 時(shí)鐘輸出選擇模塊、8bit SPI 時(shí)鐘采集生成模塊、16bit SPI 時(shí)鐘采集生成模塊、24bit SPI 時(shí)鐘采集生成模塊、8bit 數(shù)據(jù)移位模塊、16bit 數(shù)據(jù)移位模塊、24bit 數(shù)據(jù)移位模塊。
三、功能框圖：
SPI_MODES 為輸入模式選擇端口：
--“01”is 8bit 傳輸模式
--“10”is 16bit 傳輸模式
--“11”is 24bit 傳輸模式
CLKS 為整個(gè)模塊的基準(zhǔn)時(shí)鐘
DBINOUTS 為并行數(shù)據(jù)輸入端口：
--8bit 模式為DBINOUTS（7 downto 0）
--16bit 模式為DBINOUTS（15 downto 0）
--24bit 模式為DBINOUTS（23 downto 0）
SPI_WR 為啟動(dòng)SPI 傳輸?shù)男盘?hào)
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