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1.8V千兆以太網(wǎng)收發(fā)器低抖動(dòng)時(shí)鐘電路
摘要: 采用新型的高速鑒頻鑒相器(TSPC) 、典型的抗抖動(dòng)的電荷泵和對(duì)稱(chēng)負(fù)載差分延遲單元,設(shè)計(jì)了0.18μm標(biāo)準(zhǔn)CMOS工藝、1.8V 工作電壓的鎖相環(huán),經(jīng)過(guò)系統(tǒng)穩(wěn)定性驗(yàn)證和spice 仿真,125 MHz 的最大時(shí)鐘輸出在(75 ℃) 情況下,具有±3σ= 70 ps 左右的long2term低抖動(dòng). 同時(shí),在3 種不同工藝下施加0. 1 Vpeak2peak正弦電源噪聲時(shí),對(duì)電路的工作情況進(jìn)行了仿真,均能很好滿足電路設(shè)計(jì)的要求(對(duì)于1000 Base2T,Δt = 8 ns/ 16 = 500 ps ,根據(jù)
時(shí)鐘恢復(fù)算法的仿真,較嚴(yán)格peak2peak 抖動(dòng)要求約為(2 %～3 %) ×baud = 160～240 ps) .
關(guān)鍵詞: 模擬集成電路; 鑒相器; 電荷泵; 壓控振蕩器; 瞬時(shí)抖動(dòng); 長(zhǎng)期抖動(dòng)
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