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從狀態機的角度，介紹一種I 2C 控制核的VHDL 設計方法。將其嵌入到FPGA 中， 用于實現與TMS320C6000 系列DSP 的接口，并配合DSP 的軟件完成對視頻采集與顯示處理系統中數字視頻編、解碼器工作模式寄存器的配置及其狀態查詢。著重介紹I2C控制核的總體設計方案，詳細描述其內部命令狀態機和時序狀態機的工作原理及相應的VHDL 代碼。此外，介紹I2C 控制核與DSP 相互通信中斷處理機制的VHDL 實現方法。最后， 給出在Xilinx 公司的ISE6.1+ModelSimXE5.7c 軟件平臺中進行EDA 的綜合結果與時序仿真圖。
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