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      電子發(fā)燒友網(wǎng)>電子資料下載>電子論文>嵌入式技術(shù)論文>基于門(mén)控時(shí)鐘的寄存器傳輸級(jí)功耗優(yōu)化

      基于門(mén)控時(shí)鐘的寄存器傳輸級(jí)功耗優(yōu)化

      2009-08-13 | rar | 217 | 次下載 | 5積分

      資料介紹

      隨著深亞微米技術(shù)的發(fā)展，功耗已經(jīng)成為現(xiàn)代超大規(guī)模集成電路設(shè)計(jì)中的一個(gè)主要設(shè)
      計(jì)約束.本文在設(shè)計(jì)多點(diǎn)控制協(xié)議MPCP模塊中，采用插入門(mén)控時(shí)鐘這一技術(shù)以降低芯片功耗.針對(duì)插入門(mén)控寄存器造成測(cè)試很難控制這個(gè)問(wèn)題，采取在鎖存器的前后加入控制點(diǎn)的方法，解決了由于插入門(mén)控時(shí)鐘而對(duì)可測(cè)性造成的影響.最后，使用SMIC的0.25um CMOS工藝，并用Synopsys的power complier進(jìn)行功耗優(yōu)化，達(dá)到了很好的效果.
      集成電路是20世紀(jì)發(fā)展起來(lái)的新興高技術(shù)產(chǎn)業(yè)之一。自從1958年Texas Instrument的Jack Kilby生產(chǎn)出第一塊集成電路起，集成電路產(chǎn)業(yè)一直保持著驚人的發(fā)展速度。正如Intel的創(chuàng)始人之一GordonMoore博士所預(yù)言的，每14～18個(gè)月，芯片上可集成的晶體管數(shù)目將增長(zhǎng)一倍，以微處理器芯片為例，集成電路的規(guī)模已經(jīng)從1971年Intel 4004的2300個(gè)晶體管發(fā)展到現(xiàn)在的130nm制程Banias核心的7700萬(wàn)個(gè)晶體管24.5W的最大散熱功率（TDP，Thermal Design Power）和90nm制程Dothan核心的1.4億個(gè)晶體管21W的最大散熱功率[1]。
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