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嵌入式RISC處理器體系結(jié)構(gòu)并行技術(shù)的研究

2011-08-18 | pdf | 411 KB | 次下載 | 免費

資料介紹

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通過對目前國內(nèi)外主流嵌入式處理器體系結(jié)構(gòu)創(chuàng)新與發(fā)展的研究,著重從處理器體系結(jié)構(gòu)中RISC規(guī)則的突破、數(shù)據(jù)處理、多線程、多核處理器的構(gòu)成等多種并行技術(shù)的應(yīng)用,對提高系統(tǒng)運行效率和降低運行功耗,作了較為全面的分析,同時研究了這些并行機制的實現(xiàn)技術(shù)。研究表明,嵌入式處理器結(jié)構(gòu)中并行技術(shù)的應(yīng)用,是應(yīng)對目前嵌入式應(yīng)用高性能、低功耗挑戰(zhàn)的有效方法。
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