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DFT分步法原理分析

2017-11-11 | rar | 0.65 MB | 次下載 | 免費(fèi)

資料介紹

  隨著芯片規(guī)模的增大,低功耗不僅是在功能與性能方面對(duì)設(shè)計(jì)者的挑戰(zhàn)越來越大,同時(shí)對(duì)于測(cè)試而言,隨著SCAN CELL的增多,在SCAN測(cè)試時(shí),芯片的功耗也會(huì)增大。功耗越大,則芯片的溫度升高,導(dǎo)致芯片內(nèi)部的電性參數(shù)發(fā)生偏移,掃描鏈測(cè)試失敗。這對(duì)DFT(Design for Test)以及ATPCJ(Automatic Test Pattern Ceneration)提出了更高的挑戰(zhàn)。

DFT分步法原理分析

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