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提出一種基于sketch數(shù)據(jù)結(jié)構(gòu)的軟件定義測(cè)量數(shù)據(jù)平面硬件模型，并在以現(xiàn)場(chǎng)可編程邏輯門(mén)陣列（FPGA）為核心的可編程網(wǎng)絡(luò)設(shè)備N(xiāo)etMagic上進(jìn)行了實(shí)現(xiàn)。利用部署在硬件FPGA高速SRAM中的通用sketch數(shù)據(jù)結(jié)構(gòu)高效地采集數(shù)據(jù)平面流量數(shù)據(jù)，控制平面收集并緩存統(tǒng)計(jì)數(shù)據(jù)，提供給上層的測(cè)量應(yīng)用使用。使用count-min sketch和2-universal散列函數(shù)實(shí)現(xiàn)了在高速流量下實(shí)時(shí)的分組處理和流量統(tǒng)計(jì)；使用Bloom filter在控制平面恢復(fù)流量的原始5元組信息，解決了sketch數(shù)據(jù)結(jié)構(gòu)的不可逆問(wèn)題。使用CERNET骨干網(wǎng)流量數(shù)據(jù)對(duì)原型系統(tǒng)進(jìn)行的評(píng)估結(jié)果表明，該原型系統(tǒng)使用極其有限的硬件資源實(shí)現(xiàn)了對(duì)較大規(guī)模網(wǎng)絡(luò)流量的實(shí)時(shí)測(cè)量，同時(shí)具備較好的測(cè)量精度。
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