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      TP RAM的面積及功耗優(yōu)化

      2018-01-19 | rar | 0.40 MB | 次下載 | 3積分

      資料介紹

      　　隨著芯片集成度越來越高，隨機(jī)存儲器（random access memory，RAM）在片上系統(tǒng)（system on chip，SoC）中的占比也越來越高，因此RAM對SoC的面積及功耗的貢獻(xiàn)也越來越大。相同容量的偽雙口RAM（two ports RAM，TP RAM）與單口RAM （single port RAM，SP RAM）相比，前者的面積及功耗更大。降低SoC的面積及功耗可以節(jié)省成本，延長芯片壽命并進(jìn)一步提升市場競爭力。而TP RAM作為RAM的一種常用類型，在SoC中的比重也很大。因此降低TP RAM的面積及功耗，是降低整個SoC面積及功耗的有效途徑。

      　　為了降低TP RAM的面積及功耗，提出一種TP RAM的優(yōu)化設(shè)計方法。在TP RAM讀寫時鐘相同的情況下，將TP RAM替換成SP RAM，并在SP RAM外圍增加讀寫接口轉(zhuǎn)換邏輯，優(yōu)化后的RAM對外接口不變，并可實(shí)現(xiàn)原TP RAM的功能。該優(yōu)化方法可使RAM面積減少24.5%，功耗降低45.16%。

      TP RAM的面積及功耗優(yōu)化

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