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針對拖線陣聲納大規(guī)模發(fā)展帶來的高速數(shù)據(jù)實時傳輸需求，借助Xilinx FPGA平臺將千兆以太網(wǎng)傳輸技術(shù)應(yīng)用于傳輸系統(tǒng)設(shè)計中。同時考慮到傳輸節(jié)點屬水下核心工作模塊，工作可靠性要求高，提出一種雙向環(huán)路冗余傳輸方案，以賦予傳輸系統(tǒng)一定的容錯工作性能。設(shè)計以FPGA芯片為核心，利用內(nèi)嵌的以太網(wǎng)MAC控制器硬核，結(jié)合物理層PHY芯片完成了傳輸控制單元的開發(fā)，并利用Verilog語言開發(fā)了基于雙重乒乓切換機制的數(shù)據(jù)處理模塊，方便多個傳輸控制單元間進行數(shù)據(jù)幀的流水級轉(zhuǎn)發(fā)。測試結(jié)果表明，鏈路的數(shù)據(jù)傳輸速率穩(wěn)定在500 Mbps以上，并且能夠?qū)崿F(xiàn)對故障節(jié)點的隔離，具有容錯工作性能。傳輸系統(tǒng)高效可靠，已用于某型拖線陣聲納系統(tǒng)試樣階段的研制。
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