modelsim

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　　Mentor公司的ModelSim是業(yè)界最優(yōu)秀的HDL語言仿真軟件，它能提供友好的仿真環(huán)境，是業(yè)界唯一的單內(nèi)核支持VHDL和Verilog混合仿真的仿真器。它采用直接優(yōu)化的編譯技術(shù)、Tcl/Tk技術(shù)、和單一內(nèi)核仿真技術(shù)，編譯仿真速度快，編譯的代碼與平臺(tái)無關(guān)，便于保護(hù)IP核，個(gè)性化的圖形界面和用戶接口，為用戶加快調(diào)錯(cuò)提供強(qiáng)有力的手段，是FPGA/ASIC設(shè)計(jì)的首選仿真軟件。

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modelsim技術(shù)

基于vivado平臺(tái)和modelsim的仿真和應(yīng)用測試

很多人用zynq平臺(tái)做視頻圖像開發(fā)，但是對vdma了解比較少，上手起來稍微有些困難，我針對這一現(xiàn)象，做了一個(gè)基于vivado和modelsim的仿真和應(yīng)...

2018-06-30 標(biāo)簽：modelsim vivado 5767 0

Xilinx ISE是如何調(diào)用ModelSim進(jìn)行仿真的

在我們用ModelSim仿真的時(shí)候經(jīng)常是修改一點(diǎn)一點(diǎn)修改代碼，這樣會(huì)造成一個(gè)無奈的操作循環(huán)：修改代碼--->編譯代碼--->仿真設(shè)置--->進(jìn)入仿真頁面...

2017-02-11 標(biāo)簽：Xilinx ModelSim 1.1萬 0

記利用compxlibgui工具編譯Xilinx庫

當(dāng)ISE調(diào)用ModelSim進(jìn)行仿真的時(shí)候，如果在FPGA設(shè)計(jì)中使用了Xilinx提供的的IP core或者其他的原語語句，ModelSim不添加Xil...

2017-02-11 標(biāo)簽：賽靈思 Xilinx ModelSim 1473 0

在ISE啟動(dòng)modelsim時(shí)遇到問題與解決

1。我在ISE中啟動(dòng)modelsim時(shí)出現(xiàn)了下面的錯(cuò)誤 Loading work.tb_ic1_func # ** Error: (vsim-19) F...

2017-02-11 標(biāo)簽：modelsim ISE 1.0萬 0

減少Xilinx Ise與Modelsim聯(lián)合仿真的錯(cuò)誤方法

我們經(jīng)常使用Xilinx Ise與Modelsim聯(lián)合仿真，但是經(jīng)常出現(xiàn)一些由于庫沒有編譯而出現(xiàn)的錯(cuò)誤！下面是我總結(jié)的方法：

2017-02-11 標(biāo)簽：Xilinx Modelsim 1574 0

在modelsim中指定賽靈思的仿真庫方法

批命令 A、開始-運(yùn)行：cmd 在DOS窗口輸入：“ compxlib –s mti_se –f all –l all –o c:\Modeltech ...

2017-02-11 標(biāo)簽：賽靈思 Xilinx modelsim 2149 0

通過文件讀寫方式實(shí)現(xiàn)Matlab和Modelsim的聯(lián)合仿真的經(jīng)驗(yàn)總結(jié)

雖然Modelsim的功能非常強(qiáng)大，仿真的波形可以以多種形式進(jìn)行顯示，但是當(dāng)涉及到數(shù)字信號處理的算法的仿真驗(yàn)證的時(shí)候，則顯得有點(diǎn)不足

2017-02-11 標(biāo)簽：FPGA Matlab Modelsim 1493 0

ISE聯(lián)合modelsim功能仿真和綜合后仿真

1、代碼輸入(1)、新建一個(gè)ISE工程，名字為count4。(2)、新建一個(gè)verilog文件

2017-02-10 標(biāo)簽：modelsim ISE 5453 0

使用ModelSim自動(dòng)生成狀態(tài)機(jī)FSM的狀態(tài)轉(zhuǎn)換圖

HDL代碼設(shè)計(jì)中重要的內(nèi)容之一就是設(shè)計(jì)程序的狀態(tài)機(jī)FSM，狀態(tài)轉(zhuǎn)換控制著整個(gè)程序的流程，為了理解程序，我們經(jīng)常需要把狀態(tài)機(jī)的狀態(tài)轉(zhuǎn)換圖畫出來，這樣看起來...

2017-02-10 標(biāo)簽：HDL ModelSim 狀態(tài)機(jī) 1.5萬 0

modelsim中的兩個(gè)操作：do wave.do 和combine signals

do wave.do 在ISE中聯(lián)合使用modelsim中仿真時(shí)，經(jīng)常要修改了ISE里面的程序然后重新仿真，重新加載程序可以使用do

2017-02-10 標(biāo)簽：modelsim 2759 0

FPGA核心知識(shí)詳解（3）：那些讓FPGA初學(xué)者糾結(jié)的仿真

電子發(fā)燒友網(wǎng)核心提示：對于FPGA初學(xué)者而言，如何正確了解并理解FPGA的仿真是關(guān)鍵。應(yīng)廣大FPGA初學(xué)者和愛好者要求，電子發(fā)燒友網(wǎng)編輯根據(jù)多名在FPG...

2012-12-28 標(biāo)簽：FPGA 仿真 Nios II 1.2萬 5

ModelSim功能及使用入門

ModelSim是工業(yè)界最優(yōu)秀的語言仿真器，它提供最友好的調(diào)試環(huán)境，是作FPGA、ASIC設(shè)計(jì)的RTL級和門級電路仿真的首選。它支持PC和UNIX、LI...

2011-11-11 標(biāo)簽：FPGA ASIC ModelSim 9306 0

modelsim仿真學(xué)習(xí)筆記(精華篇)

功能仿真不是一個(gè)孤立的過程，其和綜合、時(shí)序分析等形成一個(gè)反饋工作過程，只有這個(gè)過程收斂，各個(gè)環(huán)節(jié)才有意義。而孤立的功能仿真通過是沒有意義的，如果在時(shí)序分...

2011-03-03 標(biāo)簽：仿真 modelsim 7872 3

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Protues

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Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
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FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長寬，直插，貼片，焊盤的大小，管腳的長寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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　　Artix-7 系列：相對于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對的市場領(lǐng)域。
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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
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時(shí)鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號，也可以是壓力、溫度、濕度、位移、聲音等非電信號；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號的變化量。
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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
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