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詳細講解SDC語法中的set_input_delay和set_output_delay

在數字集成電路設計中，Synopsys Design Constraints（SDC）是一種重要的約束語言，用于指導綜合、布局布線等后續流程。

2024-05-06 標簽：集成電路 SDC 時鐘信號 4737 0

SDC的基本語法舉例：如何在SoC設計中使用SDC？

在數字集成電路設計中，SoC（System on Chip）是一種將多個模塊集成在單個芯片上的技術。

2024-05-01 標簽：集成電路單芯片 SoC設計 2566 0

我們該如何應對SOC中越來越龐大和復雜的SDC約束？

SOC設計變得越來越復雜，成本越來越高，設計和驗證也越來越困難。

2024-03-13 標簽：EDA工具 SoC設計信號完整性 1698 0

對于芯片中的復位信號我們通常會有哪些特殊處理？

經常在面試時問到一個問題：對于芯片中的復位信號我們通常會有哪些特殊處理？這個時候我一般希望得到的回答包括：復位消抖、異步復位同步撤離、降頻復位、關斷時鐘...

2023-12-25 標簽：寄存器 D觸發器 SDC 3363 0

復位那些小事—系統解復位的特殊處理

解復位就是復位撤離，系統解復位就是復位結束了系統準備開始工作。

2023-12-04 標簽：保護電路寄存器 SDC 2435 0

SDCardUtils封裝類應用：設備信息獲取實現方法

一、獲取手機基本信息(廠商、型號等參數) 二、設備信息獲取實現圖三、獲取手機設備寬、高、IMEI 信息四、獲取手機廠商名、產品名、手機...

2023-11-13 標簽：Android SD卡 SDC 1139 0

如何在Linux使用LVM擴容邏輯卷？在Linux使用LVM擴容邏輯卷的方法

新添加兩塊硬盤，然后查看添加后的硬盤標識為sdb和sdc

2023-11-13 標簽：Linux SDC LVM 2156 0

談談芯片中的層次化的設計（hierarchy design）

層次化設計適當下非常流行的設計思路，隨著芯片的規模越來越大，fullchip的數據量和復雜度和過去已經不能同日而語了，無論是工具的runtime還是Qo...

2023-10-18 標簽：DDR 芯片設計 SoC芯片 4934 0

什么是邏輯綜合？邏輯綜合的流程有哪些？

邏輯綜合是將RTL描述的電路轉換成門級描述的電路，將HDL語言描述的電路轉換為性能、面積和時序等因素約束下的門級電路網表。

2023-09-15 標簽：寄存器 RTL SDC 6384 0

大家需要什么樣的clocktree呢？芯片的動脈CLOCK TREE介紹

我覺得稱時鐘樹為芯片的大動脈一點也不夸張，因為所有flipflop 翻轉都要受到它的控制。而時鐘樹的設計到實現是一個很復雜的過程，從流程上說，它牽扯到使...

2023-07-21 標簽：控制器分頻器 SDC 3571 0

聊聊ASIC設計約束與SDC命令

根據ASIC邏輯設計，優化的約束是速度和面積。在物理設計中，我們需要對面積、速度和功率進行優化設計。根據所需的技術節點和策略進行更好的功耗規劃，總是有助...

2023-07-11 標簽：處理器 ASIC設計 DRC 963 0

ASIC設計約束與SDC命令

2023-07-09 標簽：asic 數字IC SDC 958 0

探討一下SDC的各種語法構成和整體結構

SDC是一個設計從RTL到netlist的橋梁，是FE/ME/BE都需要掌握的一項基本技能。通常情況來說，由前端工程師（designer）提供SDC文件...

2023-07-06 標簽：EDA工具 RTL DRC 5158 0

時序分析基本概念介紹—時鐘sdc

雖然sdc大大小小有上百條命令，但實際常用的其實就那么10幾條。今天我們來介紹下與時鐘相關的命令。

2023-07-05 標簽：時序分析緩存器 SDC 2867 0

時序分析基本概念介紹<sdc檢查>

sdc是整個設計中最重要的文件，它的正確與否直接決定了PR能否順利進行以及timing的最終sign off。

2023-07-05 標簽：時序分析 STA SDC 3991 0

介紹基本的sdc時序特例

今天我們要介紹的基本sdc是 **時序特例** ，也就是我們常說的Path exception。針對一些路徑需要的一些特殊設定，常用的有set_fals...

2023-07-03 標簽：寄存器 SDC 時序分析器 1176 0

時序分析基本概念—SDC概述

今天我們要介紹的時序概念是設計約束文件 **SDC** . 全稱 ***Synopsys design constraints*** . SDC是一個設...

2023-07-03 標簽：時序分析 DRV SDC 7724 0

為什么時鐘樹上要用clock inverter(min pulse width check)？

最小脈沖寬度檢查可確保時鐘信號的寬度足夠寬，以便采集到正確的數據，保證設計功能。

2023-06-29 標簽：寄存器 SDC VDD 2215 0

SDC是如何煉成的？怎么去驗收SDC呢？

STA是由SDC驅動的，所以SDC的完整性、正確性和一致性直接決定著綜合、布局布線以及STA的有效性。

2023-06-28 標簽：RTL STA SDC 4943 0

MCP電路實現方法及命令優先級實例

需要強調的是需要加嚴的部分，對于異步路徑，往往需要通過set_max_delay來約束，防止路徑過長。

2023-06-27 標簽：寄存器 CDC 狀態機 1910 0

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