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Verilog HDL是一種硬件描述語言（HDL:Hardware Description Language），以文本形式來描述數字系統硬件的結構和行為的語言，用它可以表示邏輯電路圖、邏輯表達式，還可以表示數字邏輯系統所完成的邏輯功能。

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verilog中有符號數和無符號數的本質探究

不知道有沒有人像我一樣，長久以來將verilog中的有符號數視為不敢觸碰的禁區。

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布斯算法（Booth Algorithm）乘法器的Verilog實現

Booth 的算法檢查有符號二的補碼表示中 'N'位乘數 Y 的相鄰位對，包括低于最低有效位 y?1 = 0 的隱式位。

2023-12-04 標簽：寄存器 Verilog 乘法器 4094 0

講一講芯片設計中的verilog是什么

相信不少人都聽過verilog這個詞，今天我就想講一講我所理解的verilog是什么。

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Verilog代碼：if-else和case的電路結構和區別

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分享一些SystemVerilog的coding guideline

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2023-11-20 標簽：fpga Verilog HDL 1026 0

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2023-11-20 標簽：fpga 以太網交換機 974 0

現在公司里做設計是用SV還是Verilog？

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CRC校驗碼的多種Verilog實現方式

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使用枚舉類型表示狀態機進入死循環

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