verilog

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Verilog HDL是一種硬件描述語(yǔ)言（HDL:Hardware Description Language），以文本形式來(lái)描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語(yǔ)言，用它可以表示邏輯電路圖、邏輯表達(dá)式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。

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verilog技術(shù)

verilog輕松實(shí)現(xiàn)高分辨率DDS

根據(jù)公式2我們可以得到：N越大，也就是頻率控制字位寬越大，那么分辨率越高，我們?cè)O(shè)置的任意頻率都可以做到更接近，頻譜上就越看不出差別。而且我們可以知道，這...

2019-02-04 標(biāo)簽：Verilog DDS 調(diào)整器 6037 0

PS2鍵盤(pán)編碼Verilog源程序分享

之前探討過(guò)PS/2鍵盤(pán)編解碼以及數(shù)據(jù)傳輸協(xié)議，這次自己動(dòng)手實(shí)現(xiàn)了利用FPGA接收鍵盤(pán)編碼，然后通過(guò)串口傳輸?shù)絇C。做的比較簡(jiǎn)單，只是通過(guò)FPGA把大寫(xiě)字...

2018-07-15 標(biāo)簽：Verilog 源程序 PS2鍵盤(pán) 6037 0

仿真Xilinx網(wǎng)表

Xilinx-vivado的網(wǎng)表形式有edf和dcp兩個(gè)方式，兩個(gè)方式各有不同。對(duì)于仿真來(lái)說(shuō)，兩者均需轉(zhuǎn)換為verilog的形式進(jìn)行仿真，只是使用的命令不同。

2022-12-20 標(biāo)簽：Xilinx 仿真 Verilog 6030 0

如何利用verilog驗(yàn)證二分法查找的設(shè)計(jì)代碼

下面是產(chǎn)生輸出文件的過(guò)程，這里我們?cè)O(shè)置輸出結(jié)果的格式是fsdb，當(dāng)然我們也可以設(shè)置成vcd的格式。fsdb的文件size比較小，而且利用verdi的波形...

2018-11-26 標(biāo)簽：電路服務(wù)器 verilog 5968 0

偶數(shù)分頻、奇數(shù)分頻、半整數(shù)分頻和小數(shù)分頻詳解

初學(xué) Verilog 時(shí)許多模塊都是通過(guò)計(jì)數(shù)與分頻完成設(shè)計(jì)，例如 PWM 脈寬調(diào)制、頻率計(jì)等。而分頻邏輯往往通過(guò)計(jì)數(shù)邏輯完成。本節(jié)主要對(duì)偶數(shù)分頻、奇數(shù)分...

2023-03-29 標(biāo)簽：PWM Verilog 時(shí)鐘 5886 0

Verilog中的數(shù)據(jù)位操作技巧

FPGA相比MCU而言，在數(shù)據(jù)位操作上有很明顯的優(yōu)勢(shì)。FPGA支持任意位拼接以及數(shù)據(jù)截取操作。本篇主要是總結(jié)和分享一些對(duì)數(shù)據(jù)位操作的實(shí)用語(yǔ)法技巧。內(nèi)容不...

2023-10-01 標(biāo)簽：fpga mcu Verilog 5830 0

基于FPGA的Verilog實(shí)現(xiàn)VGA驅(qū)動(dòng)電路

VGA全稱(chēng)是Video Graphics Array，即視頻圖形陣列，是一個(gè)使用模擬信號(hào)進(jìn)行視頻傳輸?shù)臉?biāo)準(zhǔn)。分辨率高，顯示速度快。一、傳輸協(xié)議 VGA...

2020-11-20 標(biāo)簽：fpga Verilog 模擬信號(hào) 5807 0

格雷碼與二進(jìn)制轉(zhuǎn)換

格雷碼是一種循環(huán)二進(jìn)制編碼，特點(diǎn)是相鄰數(shù)變化時(shí)只有一位數(shù)據(jù)跳變。

2023-01-17 標(biāo)簽：二進(jìn)制仿真 Verilog 5800 0

基于Verilog實(shí)現(xiàn)2ASK的調(diào)制

在進(jìn)行無(wú)線通信時(shí)，基帶產(chǎn)生的信號(hào)需要通過(guò)天線發(fā)送出去，需要滿(mǎn)足一個(gè)條件，即欲發(fā)射信號(hào)的波長(zhǎng)與天線的尺寸可比擬（通常認(rèn)為天線尺寸應(yīng)大于波長(zhǎng)的十分之一），這...

2019-04-29 標(biāo)簽：無(wú)線通信 Verilog 2ASK 5759 0

淺談SystemVerilog中的數(shù)據(jù)類(lèi)型轉(zhuǎn)換

兩種形式實(shí)現(xiàn)的功能都是將源表達(dá)式src_exp轉(zhuǎn)換給目標(biāo)變量dest_var，那么既生瑜何生亮，實(shí)現(xiàn)的功能都一樣，在具體使用時(shí)仿真工具或者用戶(hù)如何知道使...

2022-09-28 標(biāo)簽：Verilog System 數(shù)據(jù)類(lèi)型 5691 0

詳解Verilog的一些基本要素

前面已經(jīng)說(shuō)到，模塊名的定義要符合標(biāo)識(shí)符的定義，那么什么是標(biāo)識(shí)符呢？它的語(yǔ)法是什么呢？

2019-02-11 標(biāo)簽：寄存器 verilog 5617 0

ModelSim手動(dòng)仿真教程

在開(kāi)始動(dòng)手仿真之前，首先，我們需要?jiǎng)?chuàng)建一個(gè)文件夾用來(lái)放置我們的 ModelSim 仿真工程文件，這里我們就在之前創(chuàng)建的 Quartus 工程目錄下的 s...

2022-07-11 標(biāo)簽：仿真 Verilog ModelSim 5546 0

Verilog邏輯設(shè)計(jì)中的循環(huán)語(yǔ)句和運(yùn)算符

“ 本文主要分享了在Verilog設(shè)計(jì)過(guò)程中一些經(jīng)驗(yàn)與知識(shí)點(diǎn)，主要包括循環(huán)語(yǔ)句(forever、repeat、while和for)、運(yùn)算符。”

2022-03-15 標(biāo)簽：Verilog C語(yǔ)言 5524 0

如何用小腳丫FPGA核心板實(shí)現(xiàn)4位加法器功能

在上次的文章 - 淺談“數(shù)字電路”的學(xué)習(xí)（8）- 編碼器、譯碼器、多路復(fù)用器、解復(fù)用器的關(guān)系和應(yīng)用 - 中，我梳理了一下數(shù)字電路教程中組合邏輯部分的一些...

2021-10-11 標(biāo)簽：電路 Verilog 加法器 5512 0

IC設(shè)計(jì)基礎(chǔ)：Verilog計(jì)算1的數(shù)量

如下所示，采用循環(huán)語(yǔ)句+移位+邏輯與1+累加來(lái)實(shí)現(xiàn)1的統(tǒng)計(jì)。最終調(diào)用函數(shù)獲得輸入信號(hào)中1的數(shù)量。

2023-05-11 標(biāo)簽：IC設(shè)計(jì)信號(hào)Verilog 5464 0

常用的時(shí)序反標(biāo)方法和EDA工具反標(biāo)方法

前段時(shí)間，一個(gè)朋友聊敘到這個(gè)后仿真任務(wù)命令都咋用，隨即整理了下，可以完成基本的后仿真不成問(wèn)題，但是如果還要完成一些其他的幺蛾子，那就需要各位仔細(xì)研讀各工...

2023-10-25 標(biāo)簽：仿真 Verilog System 5435 0

Verilog中跨模塊調(diào)用的兩種不同方式的優(yōu)缺點(diǎn)討論

在寫(xiě)Verilog TestBench，為了更方便更抽象地對(duì)底層模塊內(nèi)部的信號(hào)進(jìn)行控制，經(jīng)常會(huì)使用到跨模塊調(diào)用的方式，這個(gè)就叫做Cross Module...

2023-06-06 標(biāo)簽：Verilog DUT 5419 0

正點(diǎn)原子開(kāi)拓者FPGA：Verilog簡(jiǎn)介

Verilog HDL是一種硬件描述語(yǔ)言，以文本形式來(lái)描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語(yǔ)言，用它可以表示邏輯電路圖、邏輯表達(dá)式，還可以表示數(shù)字邏輯系統(tǒng)所完...

2019-09-09 標(biāo)簽：fpga 電路圖 verilog 5377 0

一個(gè)合格FPGA 工程師的基本要求

一個(gè)合格的FPGA工程師需要掌握哪些知識(shí)？這里根據(jù)自己的一些心得總結(jié)一下，其他朋友可以補(bǔ)充啊。

2017-02-11 標(biāo)簽：FPGA Verilog 5320 0

SystemVerilog中“軟約束”與“硬約束”的應(yīng)用示例

示例中采用的是“硬約束”，因?yàn)槎x在類(lèi)中的約束與隨機(jī)時(shí)指定的內(nèi)嵌約束“矛盾”，所以導(dǎo)致約束解析器解析隨機(jī)失敗，即“硬約束”要求所有相關(guān)的約束條件不能互相...

2023-03-15 標(biāo)簽：Verilog System 5311 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

+關(guān)注

ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門(mén)檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
AD10

AD10

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識(shí)別

識(shí)別

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FPGA開(kāi)發(fā)板

FPGA開(kāi)發(fā)板

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FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車(chē)工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車(chē)電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車(chē)制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車(chē)。
PCB封裝

PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤(pán)的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫(huà)pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語(yǔ)音交互

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PCB封裝庫(kù)

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AD09

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PDN

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QuickPcb

QuickPcb

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Artix-7

Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿(mǎn)足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

VHDL代碼

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Protel 99 se

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powerlink

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candence

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面包板

面包板

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面包板是由于板子上有很多小插孔，專(zhuān)為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
AXI

AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫(xiě)數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

特性阻抗

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特性阻抗又稱(chēng)特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱(chēng)阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門(mén)組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性?xún)r(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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FPGA教程

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紅外觸摸屏

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