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Verilog HDL是一種硬件描述語言（HDL:Hardware Description Language），以文本形式來描述數字系統硬件的結構和行為的語言，用它可以表示邏輯電路圖、邏輯表達式，還可以表示數字邏輯系統所完成的邏輯功能。

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常用串行總線(一)——UART協議(Verilog實現)

通用異步收發傳輸器（Universal Asynchronous Receiver/Transmitter)，通常稱作UART。它將要傳輸的資料在串行通...

2023-01-05 標簽：接口 Verilog uart 4369 0

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2022-09-15 標簽：fpga Verilog 程序編寫 4259 0

Verilog設計寄存器

現代邏輯設計中，時序邏輯設計是核心，而寄存器又是時序邏輯的基礎，下面將介紹幾種常見的寄存器的Verilog設計代碼供初學者進行學習理解。

2023-07-27 標簽：fpga 寄存器 Verilog 4242 0

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2024-02-23 標簽：模塊 Verilog 端口 4225 0

Windows上使用iverilog+gtkwave仿真

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2023-04-28 標簽：仿真 WINDOWS Verilog 4211 0

利用Verilog硬件描述語言實現DVB－H系統載波同步的設計方案

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2019-10-08 標簽：Verilog 代碼 Verilog HDL 4171 0

一文淺析case、casex、casez區別

先，case的描述，匹配都是從上到下進行的，如果使用了casez，看上面的casez的列表，只要輸入有z/?的話，就能和任意匹配。

2022-09-30 標簽：Verilog Case 4166 0

數字設計FPGA應用：7系列FPGA IOB

本課程以目前流行的Xilinx 7系列FPGA的開發為主線，全面講解FPGA的原理及電路設計、Verilog HDL語言及VIVADO的應用，并循序漸進...

2019-12-02 標簽：fpga xilinx verilog 4154 0

如何對Verilog/SystemVerilog代碼加密

os模塊中的system()函數接受一個字符串參數，其中包含要執行的命令。在21-22行中，line為字符串變量，和前面雙引號中的linux命令拼接在一...

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FPGA數字圖像顯示原理與實現(Verilog)

視頻圖像經過數十年的發展，已形成了一系列的規范，以VGA和HDMI為主的視頻圖像接口協議也得到定義與推廣。盡管DP、DVI、Type-C等圖像接口技術近...

2023-01-29 標簽：fpga HDMI 接口 4111 0

布斯算法（Booth Algorithm）乘法器的Verilog實現

Booth 的算法檢查有符號二的補碼表示中 'N'位乘數 Y 的相鄰位對，包括低于最低有效位 y?1 = 0 的隱式位。

2023-12-04 標簽：寄存器 Verilog 乘法器 4096 0

網表時序仿真案例：淺說$width語法

在verilog中，$width是時序檢查函數，用于檢查脈沖的位寬是否符合要求。

2024-03-01 標簽：Verilog VCS CLK 4088 0

RTL頂層自動連線的秘密武器：Emacs verilog-mode介紹

Verilog-mode.el 是用于 Emacs 的非常流行的免費 Verilog 模式，它提供上下文相關的突出顯示、自動縮進，并提供宏擴展功能以大大...

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FPGA的數字信號處理：Verilog實現簡單的FIR濾波器

該項目介紹了如何使用 Verilog 實現具有預生成系數的簡單 FIR 濾波器。

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Innovus教程：輸出用于LVS的Verilog網表文件各種控制選項

有時候網表中可能會有一些空的module（在網表中體現為Module下面沒有Cell或者準確說沒有含MOS管的有效器件），而它們在版圖里面也是不存在的，...

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SystemVerilog中的關聯數組

關聯數組實際上是一種查找表，內存空間直到被使用時才會分配，每個數據項都會有一個特定的“鍵（索引）”，索引的類型不局限于整型。

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不同verilog代碼的RTL視圖

剛開始玩CPLD/FPGA開發板的時候使用的一塊基于EPM240T100的板子，alter的這塊芯片雖說功耗小體積小，但是資源還是很小的，你寫點稍微復雜...

2018-09-15 標簽：verilog rtl 3981 0

VGA接口原理與Verilog實現編程案例解析

VGA接口是一種D型接口，上面共有15針孔，分成三排，每排五個。其中比較重要的是3根RGB彩色分量信號和2根掃描同步信號HSYNC和VSYNC針。

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