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標簽 > xilinx
Xilinx是全球領(lǐng)先的可編程邏輯完整解決方案的供應(yīng)商。Xilinx研發(fā)、制造并銷售范圍廣泛的高級集成電路、軟件設(shè)計工具以及作為預定義系統(tǒng)級功能的IP(Intellectual Property)核。
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如何用FPGA加速神經(jīng)網(wǎng)絡(luò)
到底純FPGA適不適合這種大型神經(jīng)網(wǎng)絡(luò)的設(shè)計?這個問題其實我們不適合回答,但是FPGA廠商是的實際操作是很有權(quán)威性的,現(xiàn)在不論是Intel還是Xilin...
2024-01-24 標簽:fpga神經(jīng)網(wǎng)絡(luò)Xilinx 1012 0
基于Xilinx K7-410T的高速DAC之AD9129開發(fā)筆記(二)
上一篇文章我們簡單介紹了AD9129的基礎(chǔ)知識,包括芯片的重要特性,外部接口相關(guān)的信號特性等。本篇我們重點介紹下項目中FPGA與AD9129互聯(lián)的原理圖...
Spartan-6觸發(fā)器控制信號的扇出數(shù)量統(tǒng)計方式
Xilinx推薦對于低扇出的觸發(fā)器控制信號在代碼編寫時盡量吸收進觸發(fā)器D輸入端之前的LUT中,并在XST的綜合屬性選項中提供配置項,讓XST綜合時自動將...
在以往的項目中,要控制FPGA內(nèi)部某個信號的值,往往是通過配置寄存器來實現(xiàn)的。其實Xilinx還提供了一個叫VIO的core,可以動態(tài)改變FPGA內(nèi)部某...
基于RFSoC FPGA的可擴展超導量子計算機控制系統(tǒng)
這里,我們基于多個互相同步的XCZU29DR FPGA板開發(fā)了一個可擴展系統(tǒng),每個單板擁有16個6.554GS/s的DAC通道和16個2.058GS/s...
2023-12-07 標簽:fpga射頻控制系統(tǒng) 872 0
直接在modelsim軟件內(nèi)執(zhí)行.do文件進行仿真,不通過vivado調(diào)用modelsim,vivado僅用于生成IP核。
2023-12-04 標簽:XilinxVivadoMODELSIM仿真 1602 0
現(xiàn)場可編程門陣列 (Field Programmable Gate Array, FPGA)也稱為現(xiàn)場可編程器件,是在 PROM ( Programma...
明德?lián)PPCIE開發(fā)板系列XILINX-K7試用體驗-第二篇
本文為明德?lián)P原創(chuàng)文章,轉(zhuǎn)載請注明出處!作者:Vito 明德?lián)PPCIE開發(fā)板系列XILINX-K7試用體驗-第二篇 第二周的試用計劃是實現(xiàn)常見低速協(xié)議(U...
Xilinx FPGA從spi flash啟動配置數(shù)據(jù)時的地址問題
fpga 上電時,默認是從 flash 的 0x00 地址開始讀數(shù)據(jù)。如 UG470 文檔 page144 描述
XILINX FPGA IP之AXI Traffic Generator
AXI Traffic Generator IP 用于在AXI4和AXI4-Stream互連以及其他AXI4系統(tǒng)外設(shè)上生成特定序列(流量)。它根據(jù)IP的...
Xilinx 7系列FPGA中MMCM和PLL的區(qū)別
7系列FPGA包含最多24個CMT塊,CMT具體的分布和與其他時鐘資源的關(guān)系請參考本合集(FPGA應(yīng)用開發(fā))的上一篇文章。本文主要介紹CMT內(nèi)部MMCM...
Distributed Memory Generator IP核簡介
Distributed Memory Generator IP 核采用 LUT RAM 資源創(chuàng)建各種不同的存儲器結(jié)構(gòu)。IP可用來創(chuàng)建只讀存儲器 (ROM...
Xilinx FPGA IP之Block Memory Generator AXI接口說明
之前的文章對Block Memory Generator的原生接口做了說明和仿真,本文對AXI接口進行說明。
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