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【CVM01系列】| MCU硬件設計指南:調試和編程接口

jf_pJlTbmA9 ? 來源:深圳曦華科技 ? 作者:深圳曦華科技 ? 2023-09-18 10:56 ? 次閱讀

01、RESET系統

復位MCU可使MCU從已知的初始條件下開始運行。系統復位開始時,片上穩壓器處于完全工作狀態,系統時鐘由內部參考時鐘產生。

外部引腳RESET

對于所有的復位源,RESET_B引腳都會被MCU驅動為低電平,時長至少維持128個總線時鐘周期,直到閃存初始化完成。在閃存初始化完成后,RESET_B引腳被釋放,芯片內部復位信號失效。外部保持RESET_B引腳被拉低,會延遲芯片內部復位信號的失效時間。如果發生外部引腳復位,復位模塊的狀態寄存器中相應的標志位會被置位。因此,應用軟件可以通過讀取該寄存器來檢測外部引腳的復位。

復位引腳,與其他一些GPIO類似,有一個弱的內部上拉。如果環境和客戶的應用存在噪聲影響,就必須在復位引腳上直接加一個外部上拉電阻到VDD,以避免發生隨機的或意外的復位。關于該引腳允許的電壓和電流水平,請參考器件的數據手冊。

盡管復位線中的電容對MCU來說不是必須項,但在某些情況下,為了進一步增加ESD保護,會在RESET引腳和地之間添加一個外部電容。上拉電阻和電容的值須根據應用的設計要求選擇。關于MCU可檢測到的最小RESET脈沖值,請參考器件的數據手冊。

02、RJTAG和TRACE接口

本章節列舉了一些常用的調試連接器,大多數ARM開發工具都會使用這些引腳。當開發ARM電路板時,建議使用標準的調試信號排列,以使與調試器的連接更容易。SWD/SWV引腳疊加在JTAG引腳之上,如下所示。

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△表1CVM01xx – JTAG和SWD信號描述

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△表2CVM01xx – JTAG和SWD接口

注意:可以為JTAG信號添加外部上拉/下拉電阻,以增加調試器連接的穩定性。

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△圖1JTAG/SWD信號連接

03、調試連接器引腳布局

3.120針 Cortex Debug D ETM 連接器

部分較新的ARM微控制器板使用一個1.27mm間距的20針頭(Samtec FTSH-110),用于調試和跟蹤,20針Cortex Debug D ETM連接器支持JTAG和Serial-Wire調試協議。當使用Serial-Wire調試協議時,TDO信號可用于Serial-Wire觀測器的輸出,用于跟蹤捕獲。該連接器還提供了一個4位寬的跟蹤端口,用于捕獲有更高帶寬需求的跟蹤調試(例如,當ETM跟蹤被啟用時)。

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△圖220針Cortex Debug D ETM連接器引腳布局

3.210針 Cortex 調試連接器

對于沒有ETM的設備,可使用更小的1.27毫米間距的10針連接器(Samtec FTSH-105)進行調試。與20針的Cortex Debug D ETM連接器類似,10針版本的連接器同樣支持JTAG和Serial-Wire調試協議。

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△圖310針Cortex調試連接器引腳布局

3.3傳統的20針 IDC 連接器

ARM開發板中常用的調試連接器是20針IDC連接器,20針IDC連接器支持JTAG調試、Serial-Wire調試(SWIO和SWCLK)、串行線輸出(SWO)。

nICEDETECT引腳允許目標系統檢測是否有調試器連接。當沒有調試器連接時,該引腳被拉高,而調試器連接時將該引腳連接到地,常被使用在支持多種JTAG配置的開發板;nSRST連接是可選的,調試器可通過系統控制塊(SCB)復位Cortex-M系統,所以此連接在做微控制器頂層設計時常被省略。

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△圖420針的IDC連接器

來源:深圳曦華科技

審核編輯:湯梓紅

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