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海思Hi3566V100 SDIO硬件設計要點

CHANBAEK ? 來源:飛車俠 ? 作者: Recky Zhang ? 2023-12-04 11:37 ? 次閱讀

上一期我們介紹了 【Hi3566V100 I2C 硬件設計要點】,本期將繼續(xù)給大家推出海思硬件設計系列:Hi3566V100 SDIO 硬件設計要點。

一、前言

Hi3566V100 是一顆面向車載行車記錄儀、駕駛員狀態(tài)監(jiān)控等領域推出的高性能、低功耗的 Camera SoC。Hi3566V100 內(nèi)核為 Cortex A7 MP2 @792MHz,支持雙路 1080p@30fps H.265/H.264 編碼。

二、Hi3566V100 SDIO 原理設計思路

Hi3566V100 有 2 個SDIO3.0 接口,其中 SDIO0 支持 SDIO3.0、SDXC 存儲卡;

SDIO1 只支持對接 Wi-Fi,接口支持 1.8V 和 3.3V 電平;

SDIO0_CARD_DETECT 和 SDIO0_CARD_POWER_EN 只支持 3.3V 電平;

SDIO0 數(shù)據(jù)線電壓域是 SDIO0_VOUT,自動識別 1.8V/3.3V,支持 1.8V/3.3V SD 卡。

圖片

圖 1 SDIO 信號設計要求

圖 2 SDIO0 的 SoC 端原理圖

圖片

圖 3 SDIO0 的 SD 卡端原理圖

圖片

圖 4 SDIO1 的 SoC 端原理圖

圖片

圖 5 SDIO1 的 Wi-Fi 端原理圖

三、PCB 設計思路

  1. 相鄰信號走線間距保證“3W”原則。
  2. SDIO0/1_CDATA[0:3]、SDIO0/1_CCMD 的線長以 SDIO0/1_CCLK_OUT 的線長為基準,偏差控制在 ±500mil。
  3. 如果 SDIO0 需要支持 SDXC 卡,那么 SDIO0 的數(shù)據(jù)信號必須以 GND 為參考平面,并保持信號參考平面完整。

圖片

圖 6 SDIO0 PCB 走線 圖 7 SDIO1 PCB 走線

以上便是 Hi3566V100 SDIO 硬件設計要點的全部內(nèi)容。

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學習之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報投訴
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    的頭像 發(fā)表于 12-04 11:38 ?2001次閱讀
    <b class='flag-5'>海</b><b class='flag-5'>思</b><b class='flag-5'>Hi3566V100</b> I2C<b class='flag-5'>硬件</b>設計<b class='flag-5'>要點</b>

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